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1、实验一跑马灯设计一、实验目的1、初步了解QUARTUSII软件使用方法和VerilogHDL输入的全过程。2、初步熟悉实验系统的使用。3、掌握基本的设计思路，软件环境参数配置，仿真，管脚分配，利用JTAG/AS进行下载的基本操作；二、实验要求使LED成流水的方式，在不同的状态中间进行转换，本设计中主耍是让LED显示灯按照一定时间间断来显示，通过这样的间隔来使LED按流水方式显示并循环。三、实验用到的软件和器件软件：QuartusII软件硕件：实验开发板，计算机四、实验原理（程序代码）modulemyl(clk,rst,out);inp
2、utelk;inputrst;output[7:0]out;reg[7:0]out;always@(posedgeelk)beginif(!rst)0^<=8^1111_1110;elsebeginout[0]<=out[7];out[7:l]<=out[6:0];endend附管脚分配图）endmodule五、实验步骤(详细调试步六、实验现象与结果（附图）实验二七人表决器设计一、实验目的1、熟悉VerilogHDL的编程。2、熟悉组合逻辑电路设计方法，熟悉七人表决器的工作原理。3、进一步熟悉实验系统的硕件结构。二、实验要求所谓表决器
3、就是对于一个行为，由多个人投票，如果同意的票数过半，就认为此行为可行；否则如果否决的票数过半，则认为此行为无效。七人表决器顾名思义就是由七个人来投票，当同意的票数大于或者等于4时，则认为同意；反之，当否决的票数大于或者等于4吋，则认为不同意。实验屮用7个拨动开关来表示七个人，当对应的拨动开关输入为‘1’吋，表示此人同意；否则若拨动开关输入为'0；则表示此人反对。表决的结果用一个LED表示，若表决的结果为同意，则LED被点亮；否则，如呆表决的结呆为反对，贝ULED不会被点亮。同时，数码管上显示通过的票数。三、实验用到的软件和器件软件：Q
4、uartusll软件硬件：实验开发板，计算机!1!实验原理modulevoter7(pass,vote);outputpass;input[6:0]vote;regpass;reg[2:0]sum;always@(vote)beginsum=0;if(vote[0]==l)sum=sum+l,bl;if(vote[l]==l)sum=sum+l,bl;if(vote⑵==1)sum=sum+l,bl;if(vote⑶sum=sum+l,bl;if(vote[4]==l)sum=sum+l'bl;iffvote⑸=二1)sum=sum+
5、l,bl;if(vote[6]==1)sum=sum+l,bl;if(sum[2])pass=O;//若超过4人赞成,则pass=O,LED1亮?elsepass=l;endendmodule冯小强moduleshiyan2(pass,vote,dataout);outputpass;output[6:0]data_out;reg[6:0]data_out;input[6:0]vote;regpass;reg[2:0]sumalways@(vote)beginsum=0;if(vote[0]==l)if(vote[1]=1)if(vo
6、te[2]二二1)if(vote[3]==l)if(vote[4]==l)if(vote[5]==l)if(vote[6]=1)if(sum⑵)sum二sum+1'blsum二sum+rblsum二sum+rblsum=sum+rblsum=sum+rblsum二sum+1'blsum二sum+rblpass二1;//若超过4人赞成,则pass二0，LED1亮?elsepass=0;endalways@(sum)begincase(sum)4'bOOOO4'b00014'bOOlO4,bOOll4,bOlOO4'bOlOl4'bOll
7、O4,bOllldataout二~7'bllllll0;//0data_out二bOl10000;//1data_out二~7'bl101101;//2data_out=~7'bl111001;//3dataout=~7'b0110011;//4data_out二~7'bl011011;//5data_out二~7'bl011111;//6data_out二~7'bl110000;//7defauIt:dataout二7,blllllll;endcaseendendmodule五、实验步骤六、实验现象与结果实验三矩阵键盘显示电路的设计
8、一、实验目的1、了解普通4X4键盘扫描的原理。2、进一步加深七段码管显示过程的理解。3、了解对输入/输出端口的定义方法。二、实验内容本实验要求完成的任务是通过编程实现对4X4矩阵键盘按下键的键值的读取，并在数码管上完成一
