四位二进制比较器.doc

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1、数电实验报告姓名陈世超学号14051411班级14058911专业物联网工程课程名称数字电路任课老师王长军指导老师王长军机位号实验序号实验名称实验时间实验地点一教225实验设备号实验程序源代码moduleYi(inputA,inputB,inputl,inputg,inputm,outputreglo,outputreggo,outputregmo);always@(*)beginlo=0;go=0;mo=0;if(A>B)lo=1;if(A==B)lo=l;go=g;mo=m;if(A

2、put[3:0]A,input[3:0]B,inputL,inputG,inputM,outputLO,outputGO,outputMO);wire[8:0]C;Yiy1(A[0],B[0],L,G,M,C[0],C[1],C[2]);Yiy2(A[1],B[1],C[0],C[1],C[2],C[3],C[4],C[5]);Yiy3(A[2],B[2],C[3],C[4],C[5],C[6],C[7],C[8]);Yiy4(A[3],B[3],C[6],C[7],C[8],LO,GO,MO);endmodule仿真波形电路图测试代码modulec

3、ompp;//Inputsreg[3:0]A;reg[3:0]B;regL;regG;regM;//OutputswireLO;wireGO;wireMO;//InstantiatetheUnitUnderTest(UUT)FCPuut(.A(A),.B(B),.L(L),.G(G),.M(M),.LO(LO),.GO(GO),.MO(MO));initialbegin//InitializeInputsA=0;B=0;L=0;G=0;M=0;//Wait100nsforglobalresettofinish{L,G,M}=100;repeat(16

4、)beginA=A+1;#10;repeat(16)beginB=B+1;#10;endend{L,G,M}=010;repeat(16)beginA=A+1;#10;repeat(16)beginB=B+1;#10;endend{L,G,M}=001;repeat(16)beginA=A+1;#10;repeat(16)beginB=B+1;#10;endend//Addstimulushereendendmodule思考与探索对verilog语言感觉还是朦朦胧胧的，不是很了解，但这个级联方法明白了，就是把电路图画出来，然后根据电路图来打代码就好。