Quartus-II半加器实验报告.doc

Quartus-II半加器实验报告.doc

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1、装订线CPLD/FPGA设计实验报告实验一  半加器一、创建工程工程名称:adder顶层实体文件名:adder器件:EP1C12Q240C8(要求:Cyclone系列任意器件)二、创建文件创建BlockDiagram/SchematicFile文件,实现一个半加器功能电路。三、编译工程报告中下列数据是多少四、仿真电路1、创建VWF文件2、设定“EndTime”为20us3、在VWF文件中添加NodeORBus4、编辑波形5、仿真6、画出仿真结果-2--2-

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