一位半加器实验报告

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1、实验一1位半加器一.实验目的熟悉利用QuartusH的原理图输入方法设计简单组合电路，并掌握其设计方法和软件的应用二.实验原理：1位半加器可以由与、或非等基本门构成，如下图所示。半加器的真值表中两个输入是加数A和B,输出有一个是C,另一个是D。ABCD0000011010101101三.实验内容按半加器的原理图完成输入、编译，然后进行仿真。四、步骤1、项目的新建NewProjectWizard：Directory^Ns匕Top-L

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9、N.xt>[Finish2、半加器的原理图设计倒K/wyy/ywanjwanbd3、编译FlowStatusQuartusIIVersionRevisionTop-1tvelEntityNm«PMilyDevic*Successful-MonNov2612:52:3120125.0Build14804/26/2005SJFullVtrxionyutnyutnyuanyuanMAX7000SEPB7128S1JC84-15QuartusIIFullCo«pilttionwassuccessful(0e

10、rrors,0warnings)4、仿真仿真要设置仿真结束时间,波形编辑器默认的仿真结束时间为WS,根据仿真需要,可以自由设置仿真的结束时间。选择QUARTUSII软件的Edit>EndTimo命令,弹出线路束时间对话框,在Timo框办输入仿真结束时间,点击0K按钮完成设置。5、仿真结果listerIiuIff21.15mjjfoiittr：Muhttml：•1.06mStart：1bi五.实验心得通过本次实验，我进一步熟悉了Quartusiis.0软件的使用，并进一步学习了一些对基本时序电路器件进

11、行描述和仿真，还复习了数字电路中的一些基本知识，相信对于以后本课程的学习及实验会有很大的好处。