时序逻辑电路分析举例.pdf

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1、.时序逻辑电路分析例题1、分析下图时序逻辑电路。解：1、列出驱动方程：J1K11//J2K2AQ1AQ12、列出状态方程：*//将驱动方程代入JK触发器的特性方程QJQKQ得：*/Q1Q1*//////Q2AQ1Q2AQ1Q2AQ1Q2AQ1Q23、列出输出方程：///YAQ1Q2AQ1Q24、列出状态转换表：（1）当A=1时：*/*////根据：Q1Q1；Q2Q1Q2Q1Q2；YQ1Q2得：（2）当A=0时：'..*/*//根据：Q1Q1；Q2Q1Q2Q1Q2；YQ1Q2得：5、画状态转换图：6、说明电路实现的逻

2、辑功能：此电路是一个可逆4进制（二位二进制）计数器，CLK是计数脉冲输入端，A是加减控制端，Y是进位和借位输出端。当控制输入端A为低电平0时，对输入的脉冲进行加法计数，计满4个脉冲，Y输出端输出一个高电平进位信号。当控制输入端A为高电平1时，对输入的脉冲进行减法计数，计满4个脉冲，Y输出端输出一个高电平借位信号。2、如图所示时序逻辑电路，试写出驱动方程、状态方程，画出状态图，说明该电路的功能。QQ10FF1FF01J=11J=1=1X&C1C1Z1K11K1CP解：驱动方程nnJ0XQ1J1XQ0K01K11状态方

3、程n1nnnnnnQ1XQ0Q1XQ1Q0XQ1Q0n1nnnnnnQ0XQ1Q0XQ1Q0XQ1Q0'..输出方程ZXQ1Q01、状态转换表，如表所示。状态转换图，略。2、这是一个3进制加减计数器，当X=0时为加计数器，计满后通过Z向高位进位；X=1时为减计数器，计满后通过Z向高位借位；能自启动。nnn1n1XQQQQZ1010000010001100010001011000100100101000110011111000例3、分析下图所示的计数器电路（设初始状态是0），要求（1）画出状态转换图。（2）画出时序图

4、。（3）说明是多少进制计数器。'..Q01JQ1JQQ1〉C1〉C11KQ1KQFF0FF11CP答：（1）（2）时序图CPQ0Q14、分析下图所示时序逻辑电路，写出电路的驱动方程、状态方程和输出方程，画出电路的状态转换图，说明电路实现的的逻辑功能。A为输入变量。解：（1）列写方程驱动方程：触发器的驱动方程为：/D1Q1D2AQ1Q2'..（2）列写方程驱动方程：*触发器的特性方程为：QD将驱动方程代入特性方程可得状态方程为：*/Q1D1Q1*Q2D2AQ1Q2///（3）列写输出方程：YAQ1Q2AQ1Q2（4）

5、列出状态转换表：当A=1时：*/*////根据：Q1Q1；Q2Q1Q2Q1Q2；YQ1Q2得：当A=0时：*/*//根据：Q1Q1；Q2Q1Q2Q1Q2；YQ1Q2得：（5）画状态转换图：'..（6）说明电路实现的逻辑功能：（2分）此电路是一个可逆4进制计数器，CLK是计数脉冲输入端，A是加减控制端，Y是进位和借位输出端。当控制输入端A为低电平0时，对输入的脉冲进行加法计数，计满4个脉冲，Y输出端输出一个高电平进位信号。当控制输入端A为高电平1时，对输入的脉冲进行减法计数，计满4个脉冲，Y输出端输出一个高电平借位信

6、号。'.