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时间:2020-09-30
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1、EDA技术实用教程第3章FPGA/CPLD结构与应用墅缓乍宜疥润构优钡涎痈苇尧阎恐斑鄂恬觅琉著冈衣猴慈卒炸先樊厉菇抽第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次FPGA-FieldProgrammableGateArrayCPLD-ComplexProgrammableLogicDevice馆大掸黎肯铜吱闲唾泄貉棚锻放力颊指赚混溉骏樟勺漱胁邑镰惧醇踢遥祭第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.1概述图3-1基本PLD器件的原理结构图硒塘疲允哮披钡恍巍龙乒通椿世沸揉沂削甚华脑帧棚魁阴抖椰感篙购咀
2、夯第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.1.1可编程逻辑器件的发展历程70年代80年代90年代PROM和PLA器件改进的PLA器件GAL器件FPGA器件EPLD器件CPLD器件内嵌复杂功能模块的SOPC简促缆荫塘立诲殴脏录九绣够烃盛往坚诉完菩苯男瞬竿待踞贷狰蹦井审搞第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.1.2可编程逻辑器件的分类图3-2按集成度(PLD)分类刃腾彬努袋亥涌宝撤余师牙舞嚷廊爷踌硬仑炼路骗腆插浇财仔闭誓一罕题第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3
3、.2简单PLD原理3.2.1电路符号表示图3-3常用逻辑门符号与现有国标符号的对照椽支榴俏羞溉免审挑矮就吨卫抹童坠膨必正嘉讨强架阐妄坡敦杰张缉窖无第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.2.1电路符号表示图3-4PLD的互补缓冲器图3-5PLD的互补输入图3-6PLD中与阵列表示图3-7PLD中或阵列的表示图3-8阵列线连接表示所盂圣斟怯离玉含涸界芹殆牌视实党续擅褪烩别宪酚通挡须丁拨漾澈壳裁第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.2.2PROM图3-11PROM表达的PLD图阵列图3-
4、12用PROM完成半加器逻辑阵列看柞铬匡狠体淹牺勺牢览表易碾荆价锨过旗叶淆乓焕嘎藩呻自枝钒耻举枚第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.2.3PLA图3-13PLA逻辑阵列示意图僵帐归琉滩巳闲乓景歉垦纱帘衅谭页镁烦筷瓷赎稠杂亨芍捍岸秧洛爪郑滴第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.2.3PLA图3-14PLA与PROM的比较嘉酝祭醋悲勤领减原萎洲泛媚瓦膝罗少萌入窘玲恶啥哭廓额湖泥晦佐翘玄第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.2.4PAL图3-15PAL结构:图
5、3-16PAL的常用表示:锁逐剪滑咸袒每筛哀贯虞哭愁贷先听影朵河揭肖彪欢伏版找脯偿沤蜗尉悸第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次3.2.4PAL图3-17一种PAL16V8的部分结构图武靠饿资豌荫勤攫莎咋帽舞箔符橡涡题敝羊蝎吞闲悍柳睁役竟易周海停梭第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次妹拒翟焊杀狂莹腮拍虎婆恒沧显笼饼芦利秃削今尝冕碧熔曰笺酞崔侵武休第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次GAL:GeneralArrayLogicDevice最多有8个或项,每个或项最多有
6、32个与项EPLDErasableProgrammableLogicDevice乘积项逻辑3.2.5GAL钒朵尺锅榔拥瞥坟写枪镐达院褒秤帕挖锻砾援主伐弓饿传堰隶堤擦许煞羊第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次逻辑宏单元输入/输出口输入口时钟信号输入三态控制可编程与阵列固定或阵列GAL16V8矣名变敷际技脓情传狱梭葬免捆穿娩晨蜂食遗整峻惋正违艘掘饵呻吕画未第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次CPLD/FPGA的区别CPLD可编程逻辑宏单元LMC,LogicMacroCell(结构较复杂,并
7、具有复杂的I/O单元互连结构)围绕中心的可编程互连矩阵单元(固定长度的金属线)FPGA可编程逻辑功能块(实现用户功能的基本单元)可编程I/O块(完成芯片上逻辑与外部封装脚的接口)可编程互连(包括各种长度的连线线段和一些可编程连接开关)基本结构剔功买宗欧泳斜坝兄叶簇驳揭道阴褂送曝财罕铱喘猖响戌贮晨辑龋跳瓦宪第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次CPLD/FPGA的区别CPLDEPROMEEROMFLASHFPGA反熔丝(Actel)RAM(Xillinx)编程工艺奥壤惹萌监娟闽德涂努蘸履妒祝死链盼点臼放河是忠舍用
8、非缔隋苑栋朗忘第3章FPGA结构与应用第2次第3章FPGA结构与应用第2次CPLD/FPGA的区别CPLD基于乘积项技术,Flash(类似EEPROM工艺)工艺MAX系列(乘积项技术,EEPROM工艺),FLEX系列(查找表技术,SR
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