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数字逻辑异或门实验报告.doc

数字逻辑异或门实验报告.doc

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1、一、实验名称：异或门1.设计思想：输入为A和B，若A和B相等，则输出为0，若不同则为12.用途：逻辑输入和输出3.原理图：4.真值表：5.VHDL：1.波形图：

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