实验七集成触发器的应用

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1、实验七集成触发器的应用实验基本RS触发器和D触发器一、实验目的1.熟悉并验证触发器的逻辑功能。2.掌握RS和D触发器的使用方法和逻辑功能的测试方法。二、实验预习要求1.预习触发器的相关内容。2.熟悉触发器功能测试表格。三、实验原理触发器是一个具冇记忆功能的二进制信息存储器件，是构成多种时序电路的授基本逻辑单元。触发器具有两个稳定状态，即〃0〃和〃1〃，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。1.基本RS触发器图3、1为由二个与非门交叉藕合构成的基本RS触发器。基本RS触发器貝-有置〃0〃、置和〃保持"三种功能。通常称f为置端,因为$二0时触发

2、器被置〃R为置〃0〃端，因为/?=0时触发器被置〃0〃，当£二/?二1时状态保持。基木RS触发器也可以用二个〃或非门〃组成，此时为高电平触发器。图3、1基本RS触发器2、D触发器D触发器的状态方程为：Qn+1=DO其状态的更新发生在CP脉冲的边沿，74LS74(CC4013),74LS175(CC4042)等均为上升沿触发，故又称Z为上升沿触发器的边沿触发器，触发器的状态只取决于时针到來前D端的状态。D触发器应用很广，可川做数字信号的寄存，移位寄存，分频和波形发生器等，其逻辑符号如下：图3、2双D触发器图3、3D触发器逻辑符号四、实验仪器设备1、仿真软件。2、74L

3、S74(CC4013),74LS00(CC4011)。五、练习内容及方法1•测试基本RS触发器的逻辑功能按图3、1连接电路，用两个与非门组成基本RS触发器，输入端S、R接逻辑开关的输出插口，输出端Q、0接逻辑电平显示输入接口，按表3、1的要求测试，并记录；azu代牛・enj轨点血長*K

4、触发器的逻辑功能表3、2D触发器的逻辑功能DCPQM1Qp=0Qn=l00—>11—>010—11—*0按表3、2进行测试，并观察触发器状态更新是否发牛在CP脉冲的上升沿(即01),记录在表格屮。(3)用D触发器构成分频器。按图3、4连接电路，构成2分频和4分频器。图3、4用74LS74双D触发器构成分频器在CP1端加入lKHz的连续方波，并用示波器观察CP,QI,Q2各端的波形。再取一只74LS74组件，仿图3、4电路连成8分频和16分频器六、实验报告1.整理实验所测结果，总结RS触发器和D触发器的特点。2.画出分频器实验测得的波形图。七、思考题在RS触发器中，对

5、触发器脉冲的宽度冇何要求?J-K触发器—＞实验目的1、掌握J-K触发器的逻辑功能。2、掌握集成J-K触发器逻辑功能的测试方法。3、掌握触发器Z间的相互转换方法。二、实验预习要求1、复习J-K触发器的逻辑功能。2、掌握D触发器和J-K触发器的真值表及其转换的基木方法。三、实验原理1、J-K触发器74LS112双J-K触发器的逻辑符号和J-K触发器引脚功能分别如图6、1,图6、2所示。图6、1为J-K触发器的逻辑图6、2为74LS112双J-K触发器符号引脚功能。本实验屮采用的74LS112为下降沿触发的边沿触发器。其状态方程为：QA+1二j更+及Q證其中J和K为数据输

6、入端，是触发器状态更新的依据，若J、K有两个或两个以上输入端时，组成〃与〃的关系。触发器的功能表如表6、1所示：表6、1触发器的功能表2、触发器的相互转换在集成触发器的产品屮，每一种触发器都冇自己同定的逻辑功能。但可以利用转换的方法获得具有其他功能的触发器。例如将J-K触发器转换成D触发器、T触发器、T，触发器。其转换电路如图6、3所示。5sur(a)J-K转换成D(b)J-K转换成T(c)J-K转换成T‘图6、3J-K触发器转换成D、T、T"触发器四、实验仪器设备1、仿真软件；2、74LS112（或CC4027）,74LS00（或CC4011）,74LS74（或C

7、C40⑶。五、练习内容及方法1、测试JK触发器74LS112逻辑功能。（1）测试RZ的复位、置位功能。将J,K端接逻辑开关输出插口，CP端接单脉冲，Q、Q端接至逻辑电平显示插口。在=0=1或吐=o,R。二1作用期间记录J、K及CP的状态，观察Q、Q状态并记录。XFQ1««=戏字隹勺显土童环CP隹勺.湮蚕幺祈衣来N污空JB・■入」K圭三舌诃•来冬屯・5=R=1W«*MTXff-W录歪在CK1时求隹勺・eCP±1-5«0才■■旬•日K二嫌杏不支.J=OK=1G=O；J-1K=VA2=1；尸1N=1氏时0耒一午时PiJCtQ英—及・（2）测试J-K触发器的逻辑功能；按