高性能锁存比较器设计

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1、高性能锁存比较器设计从前面流水线ADC的基本工作原理可以看出，流水线ADC的高分辨率是依靠多级量化来实现的。由于本文采用了冗余位校正技术，所以子ADC电路中比较器失调电压所引入的非线性误差完全可以通过数字校正电路得到减小，因此在比较器设计中大大放宽了对输入失调的要求。由于[39]数字校正技术可以校正1/4Vref的误差，所以对于1.5位/每级的结构来说，允许比较器有1/4Vref的失调误差，所以本文采用动态比较器以降低模数转换器的整体功耗。但是，动态比较器的回踢噪声比静态比较器大。为了提高比较器的转换速度，以及减小比较器的回踢噪声，本文加入预放大级，以隔离回踢噪声，并且由于预放大级把初始

2、输入电压放大，减小了输出电压到达终值的时间，从而提高了比较器的速度，所付出的代价是增大了比较器的整体功耗。此外，要求预放大级有较大的增益，以增加比较器的速度。图1是本文所采用的带预放大级的动态锁存比较器，它由三级结构组成：第一级是由MN1~MN3,MP1~MP2构成的预放大级，第二级是由MN4~MN5，MP3~MP8构成锁存比较级，第三级是由MN6~MN8，MP9~MP12构成的锁存缓冲级。预放大级的作用有两个：一是将输入的差分信号放大，使得比较级电路的比较时间减少，同时减少了总体延时；二是放大差分信号，从而减小差分输入信号的失调电压。MN1是预放大级的尾电流源管，MN2和MN3是预放大

3、级的输入管，MP1和MP2作为预放大级的两个有源负载，由于MP1和MP2采用二极管连接方式，所以预放大级的输出电阻很小，使得预放大级有很大的带宽和速度。比较器由两相非交叠时钟控制，其中CK1p,CK2p分别是CK1和CK2的超前相位时钟，CK1p_del是CK1p的延迟时钟，CK1p_del1是CK1p_del的反相时钟。图1带预放大级的动态比较器整体电路图图2比较器工作时序图锁存比较级电路是锁存比较器电路的核心，它通过正反馈原理，对预放大级放大后的输出信号进行判断，输出两个高低电平。MP3和MP6是锁存比较级电路的输入管，MP4和MP5管用作复位/比较控制，当锁存比较级正常工作时，MP

4、4和MP5管截止，当锁存比较级复位时，MP4和MP5管导通，并向下注入电流，MP7~MP8，MN4~MN5两个互补交叉耦合对组成了锁存比较级的正反馈环路，它比单个的交叉耦合对具有更大的增益，使得比较级电路的速度更快，而且精度也较高。这种交叉耦合对的原理图如图3所示：VDDIIVo1Vo2M1M2gnd图3交叉耦合对原理图图3中M1、M2管构成的交叉耦合对的等效模型如图4所示，其中Vin1、Vin2为M1、M2漏端的初始电压，C1、R1与C2、R2分别是M1、M2管漏端到地的等效电容和电阻。在理想情况下，M1和M2可以认为是完全相同的，所以假设R1=R2=R，C1=C2=C，我们可以得到：

5、VVVVVooo21ioss11图4交叉耦合对的等效模型其中，RC,VVV，如果gmR>>1，上面的公式可化简为：io1o2Vte()gRtm/Voi其中动态锁存比较器的时间常数是：3CWLCox0.67LgRg2Imm根据上式我们可写出动态锁存比较器的传输延时的表达式：VVOHOLtln()pL2Vi其中，VOH，VOL是比较器输出能达到的高/低电平，gm是M1，M2的跨导。从上面两个公式可以看出，通过增大M1，M2的跨导能够减小比较器电路的传输延时，即增大输入级的电流，但这样做的话会增加功耗，所以在增大电流的时候还可适当的

6、增大M1和M2的宽长比值（W/L），从而降低比较器电路的整体功耗，也实现了增大它的输入跨导的目的。为了满足锁存比较器的精度和速度的指标，所以假设V是输入电压差值，当Vinin是0.1mV，比较器电路的传输时延应小于500ps。MOS晶体管的阈值电压[41]失配与电流失配是比较器的失调电压主要来源。它的标准差可以表示为：2AVosWL其中A是一个和生产工艺相关的阈值电压失调系数，根据公式可以看出，要减小失调电压，我们可以增大比较器电路的输入管的尺寸，但这样做的话会增大寄生电容，从而降低动态锁存比较器电路的信号传输速度，3因为动态锁存比较器电路的传输时延是正比于WL的，所以在满足比较器

7、的速度要求的条件下，我们在设计其中的反馈管尺寸时，应取最小的沟道长度，和大的沟道宽度。锁存缓冲级的作用是将锁存比较级送来的输出信号转换成逻辑电平，以便与后级的数字电路相匹配。MN6，MP10和MP11是复位/比较控制管，当比较器复位时，MP10和MP11管导通，MN6管截止；当比较器进行比较工作时，MP10和MP11管截止，MN6管导通。MN7，MP9及MN8，MP12组成了两个反相器，增强比较器的驱动能力，并最终产生数字逻辑电平输