川大电子《数字电子技术》课件ch

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1、触发器特点：触发器分类：能够存储一位二进制信息的基本单元。1.能够保持的稳定状态，可用来表示逻辑0和逻辑1。2.在适当输入信号作用下，可从一种状态翻转到另一种状态；在输入信号取消后，能将新状态保存下来。按触发方式分：电位触发方式、主从触发方式及边沿触发方式按逻辑功能分：R-S触发器、D触发器、J-K触发器和T触发器组合电路：不含记忆元件、无反馈、输出与原来状态无关。第四章集成触发器触发器：1第四章集成触发器4.1基本R-S触发器4.2钟脉冲控制的R-S触发器4.3主从触发器4.4边沿触发器4.5触发器的功能

2、分类及触发器类型转换4.6激励表的文字填写法24.1基本R-S触发器4.1.1基本R-S触发器的组成及工作原理（2）由两个“与非”门构成的R-S触发器电路图（1）逻辑符号3两个稳定状态当，若Q＝0，=1,即处于0态，这是一个稳定状态；同理，若Q＝1，=0,（1态）也是一个稳定状态。4若在电路的输入端施加触发信号，触发器可以从一个稳定状态转换到另一个稳定状态。例如，设触发器起始状态（初态）为1，在端加0电平信号，即，仍为1，经过门2的延迟时间tpd2后变为1，再经过门1的延迟时间tpd1后，Q变为0，触发器转

3、换到0态。(置0端)(置1端)5图4－2给出了触发器置1的工作波形，这里假设tpd1＝tpd2＝tpd由图可见，为使置1可靠，置1负脉冲的宽度应大于2tpd。同样可以画出置0负脉冲作用下的工作波形。6(RD=1)74.1.2基本R-S触发器的逻辑功能1.基本R－S触发器的真值表及时序图表4－1基本R-S触发器的真值表（次态）（初态）8表中Q（t）为触发器初态，为次态。当，同时为低电平时，Q和均为1，使触发器互补输出功能失效。若此时同时撤销，端的低电平，则因门电路动态特性参数的不同，触发器的新态可能有3种情况

4、。设与非门1和与非门2的平均延迟时间为tpd1，tpd2，则有9①若tpd1tpd2,则（Q=1为输入先作用）;③若tpd1＝tpd2,则将在1电平及0电平之间来回震荡。如果同时撤销10图4－3示出基本R－S触发器时序图，图中假定门的传输延迟时间为0。不定状态用虚线及问号表示112.基本R－S触发器的状态转换真值表及特征方程12图4－4（a）所示的表格为状态转换真值表。不定态用d填写。由状态转换真值表可以导出次态的逻辑表达式，称为触发器的特性方程或状态方程

5、。（b）图为次态的卡诺图。由图可得（4.1）由于输入，不得同时取逻辑0电平，则或（4.2）（4.1），（4.2）式联立得:（约束条件）（4.3）133.基本R－S触发器的状态转换图和激励表144.1.3.或非门构成的基本R-S触发器如果同时撤销输入将会出现振荡15根据功能真值表列出状态转换真值表，并由此求出该触发器的特性方程为：（4.4）由特性方程（4.3）及（4.4）可见，由或非门和与非门构成的R－S触发器都具有相同的方程形式。或16与非门构成的基本R-S触发器或非门构成的基本R-S触发器两种基本R-S触

6、发器的比较：特性相同174.2钟脉冲控制的R-S触发器数字系统使用的触发器的置0或置1要受到控制信号的控制，这个控制信号称为时钟信号，记为CP。时钟脉冲信号确定触发器动作的时刻，触发器输入端的取值（输入数据）确定触发器状态转换的方向。由时钟脉冲信号控制的R－S触发器称为钟脉冲R－S触发器。184.2.1钟脉冲R－S触发器由与非门构成的钟脉冲R－S触发器如图4－7所示19图中门1，门2构成基本R-S触发器，门3,门4构成触发导引电路，S，R称为触发器的控制输入或激励端、驱动端，CP称为时钟端。由图4－7可见，

7、基本R-S触发器的输入20当CP＝0，,触发器的状态将保持不变。当CP＝1时，则,触发器的状态将随输入端S，R的输入信号而变化。通常用Qn及Qn＋1分别表示时钟控制型触发器的初态和次态。21于是根据R-S触发器的特性方程可以得到钟脉冲R-S触发器的特性方程，当CP＝1时，则有(与前面一致)(约束条件)(4.5)式（4.5）表明，在CP=1时，即时钟脉冲由低电平上跳到高电平（上升沿）以及时钟脉冲维持高电平期间，触发器状态的更新按（4.5）式进行。22在CP＝1或CP＝0期间，触发器能改变状态的触发方式称为“电

8、平触发方式”。由式（4.5）可以导出功能真值表，状态转换真值表，激励表及状态转换图，分别为图4－8的（a），（b），（c），（d）。图4－9为钟脉冲R-S触发器的时序图23真值表、状态转换真值表、激励表、状态转换图都表达同一内容但表达方式不同。p.1724要求在CP=1期间输入信号不发生变化，以避免空翻空翻25图4－10（a），（b）分别为由或非门及与或非门构成的钟脉冲R-S触发器264.3主从触发器4.3.1主