数字电路与逻辑设计复习资料含答案

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1、数字电路与逻辑设计复习资料一、单项选择题1.十进制数53转换成八进制数应为（B）。A.64B.65C.66D.1101012.将十进制数(18)10转换成八进制数是（B）。A.20B.22C.21D.233.十进制数53转换成八进制数应为（D）。A.62B.63C.64D.654.当逻辑函数有n个变量时，共有（D）种取值组合。A.B.C.D.5.为了避免干扰，MOS与门的多余输入端不能（A）处理。A.悬空B.接低电平C.与有用输入端并接D.以上都不正确6.以下电路中可以实现“线与”功能的有（C）

2、。A.TTL与非门B.TTL或非门C.OC门D.TTL异或门7.用6264型RAM构成一个位的存储器，需要（D）根地址线。A.12B.13C.14D.158.同步时序电路和异步时序电路比较，其差异在于后者（B）。A.没有触发器B.没有统一的时钟脉冲控制C.没有稳定状态D.输出只与内部状态有关9.用6264型RAM构成位的存储器，需要（D）片进行扩展。A.4B.8C.14D.1610.逻辑函数=（D）。A.B.AC.D.B11.函数的反函数为（C）。A.B.11C.D.12.在图1所示的TTL电路

3、中，输出应为（B）。A.F＝0B.F＝1C.F＝AD.F＝图113.将展开成最小项表达式应为（A）。A.B.C.D.14.用异或门实现反相功能，多余输入端应接（B）。A.地B.高电平C.低电平D.以上都不正确15.同相等的逻辑函数表达式是（D）。A.B.C.D.16.图2是CMOS电路，则输出（C）。A.B.C.D.图21117.下面可以实现线与的是（B）。A.TTL门B.OC门C.三态门D.以上都不可以18.用6264型RAM构成一个位的存储器，需要（A）根地址线。A.14B.13C.12D.

4、1119、三变量函数F(A,B,C)=A+BC的最小项表示中不含下列哪项（A）。A.m2B.m5C.m3D.m720、一片64k×8存储容量的只读存储器（ROM），有（C）。A.64条地址线和8条数据线B.64条地址线和16条数据线C.16条地址线和8条数据线D.16条地址线和16条数据线21、16个触发器构成计数器，该计数器可能的最大计数模值是（D）。A.16B.32C.162D.21622、一个64选1的数据选择器有（A）个选择控制信号输入端。A.6B.16C.32D.6423、函数的结果是

5、（C）。A.ABB.C.D.24、芯片74LS04中，LS表示：（B）。A.高速COMSB.低功耗肖特基C.低速肖特基D.低密度高速25、下列等式不正确的是（C）。A.;B.(A+B)(A+C)=A+BCC.;D.26．用或非门构成钟控R-S触发器发生竞争现象时，输入端的变化是（A）。A、00→11B、01→10C、11→00D、10→0127.对n个变量，最小项的个数为（C）。A.B.C.D.28.使用TTL集成门电路时，为实现总线系统应该选用（B）门电路。A.集电极开路TTL与非门B.三态输

6、出门C.TTL或非门D.OD门29.芯片74LS00中，LS表示（B）11A.高速COMSB.低功耗肖特基C.低速肖特基D.低密度高速30.将一个JK触发器转变成T触发器，JK触发器的输入应该采取的连接方式：（C）A.B.C.D.31.对于含有约束项的逻辑函数，用卡诺图化简时，任意项（C）处理。A.必须当作0B.必须当作1C.方便化简时当作1，不方便化简时当作0D.以上都不正确32.用全加器将8421BCD码转换成余3BCD码时，其中固定的一个输入端应接（A）。A.0011B.1100C.110

7、1D.1000二、填空题1.（0111）8421BCD＝（7）10。2.已知，则其对偶函数为。3.当逻辑函数有n个变量时，共有;种取值组合。4.为了避免干扰，MOS门的多余输入端不能悬空处理。5.在单稳态触发器、多谐振荡器、施密特触发器中具有两个稳态的电路是施密特触发器。6.已知一个四变量的逻辑函数的标准最小项表示为F(a，b，c，d)＝，那么用最小项标准表示,以及。7.如果用J-K触发器来实现T触发器功能，则T,J,K三者关系为T=J=K；如果要用J-K触发器来实现D触发器功能，则D,J,K三

8、者关系为D=J=。8.要构成17进制计数器最少需要5个触发器。9.TTL与门多余输入端应该接高电平（1），TTL或门多余输入端应该接低电平（0）。119.逻辑函数=B。10.数字电路按照功能可以分为组合逻辑电路和时序逻辑电路。11.时钟触发器根据时钟控制信号有效时机的不同，可以把触发控制的方式分为两大类，即电平触发控制方式和边沿触发控制方式。12.直接写出下列函数的反演式和对偶式：；=；=。13.在单稳态触发器、多谐振荡器、施密特触发器中具有两个稳态的电路是施密特触发器，具有两个暂态的电路是多谐