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1、数字电路与逻辑设计复习资料一、单项选择题1.十进制数53转换成八进制数应为（B）oA.64B.65C.66D.1101012•将十进制数（18）10转换成八进制数是（B）。A.20B.22C.21D.233.十进制数53转换成八进制数应为（D)oA.62B.63C.64D.654.当逻辑函数有n个变量时，共有（D）种取值组合。A.B.2nC.h2D.5.为了避免干扰，M0S与门的多余输入端不能（处理。A.悬空B.接低电平C.与有用输入端并接D.以上都不正确6.以下电路中可以实现“线与”功能的有（C)oA.T
2、TL与非门B.TTL或非门C.0C门D.TTL异或门7.用6264型RAM构成一个32Kx8位的存储器，需要（）根地址线。A.12B.13C.14D.15同步时序电路和异步时序电路比较，其差异在于后者B)oA.没有触发器B•没有统一的时钟脉冲控制C.没有稳定状态D•输出只与内部状态有关9.用6264型RAM构成32Kx32位的存储器，需要片进行扩展。A.4B.8C.14D.1610.逻辑函数F=A㊉（A㊉B）二（)oA.ADBB.AD.B11.函数F=ABC+ABCD的反函数为(C)oA.F=(A+B+C)
3、(A+B+C+D)B.F=(ABC^ABCD)C.F=(4+B+C)(4+B+C+D)D.F=A+B+C+4+B+C+D12•在图1所示的TTL屯路中，输出应为（B)oA•F=0B.F=1C.F=AD.F=A100GF0—)o13.将F=ABC^ACD+CD展开成最小项表达式应为（A.工加(0,3,4,7,8,12,14,15)B.工加(0,3,4,7,&12,13,15)C.Y加(0,2,4,7,8,12,14,15)D.丫加(0,3,4,7,&11,14,15)14.用异或门实现反相功能，多余输入端应接
4、（)oA.地B.高电平C.低电平D.以上都不正确15.同A+BC相等的逻辑函数表达式是（D)oA.A(B+C)B.(A+B)(A+C)C.A(B+C)D.(A+B)(A+C)16.图2是CMOS电路，则输出（C)oA.丫=A+B+C+D+E+FB.Y=ABCJDEFC.r=A+B+CTD+E+FD.r=(A+B+C)L(D+E+F)+10VBcD图217.下面可以实现线与的是（B）。A.TTLHB.OC门C.三态门D.以上都不可以18.用6264型RAM构成一个16Kx8位的存储器，需要（A）根地址线。A.
5、14B.13C.12D.1119、三变量函数F（A,B，C）=A+BC的最小项表示屮不含下列哪项（A）。A.m2B.m5C.m3D.m720、一片64kX8存储容量的只读存储器（ROM）,有（C）。A.64条地址线和8条数据线C.16条地址线和8条数据线B.64条地址线和16条数据线D.16条地址线和16条数据线21、16个触发器构成计数器，该计数器可能的最大计数模值是（D）。A.16B.32C.162D.21622、一个64选1的数据选择器有（A）个选择控制信号输入端。A.6B.16C.32D.6423、
6、函数F=A^A㊉B）的结果是（C）。A.ABB.ABC.ABD.AB24、芯片74LS04中，LS表示:（B）。A.高速COMSB.低功耗肖特基C.低速肖特基D.低密度高速25、下列等式不正确的是（C）。A.ABC=A+B+C;B.（A+B）（A+C）二A+BCC.A（A+B）二A+P;D.AB+^C+BC=AB+方C26、用或非门构成钟控R-S触发器发生竞争现象时，输入端的变化是（A）oA、00->11B、01-10C、ll-*00D、10—0127、对n个变量，最小项的个数为（C）。A.B.2"—1C.
7、2"D.2“+128•使用TTL集成门电路时，为实现总线系统应该选用（B）门屯路。A.集电极开路TTL与非门B.三态输出门C.TTL或非门D.0D
8、'129.芯片74LS00中，LS表示（B）A.高速COMSB・低功耗肖特基C・低速肖特基D.低密度高速29.将一个JK触发器转变成T触发器，JK触发器的输入应该采取的连接方式：(C)J=T[J=[J=Tj=TA.U=fB.Ic.U=rLU=T30.对于含有约束项的逻辑函数，用卡诺图化简时，任意项(C)处理。A.必须当作0B.必须当作1C.方便化简时当作1
9、,不方便化简时当作0D.以上都不正确31.用全加器将8421BCD码转换成余3BCD码时，其中I古I定的一个输入端应接(A)。A.0011B.1100C.1101D.1000二、填空题1.(0111)8421BCD—10。2.已知F=(A+B)uc5,则其对偶函数为F*=(AB)+(C+D)。3.当逻辑函数有n个变量时，共有_2〃;种取值组合。4・为了避免干扰，MOS门的多余输入端不能悬空处理。5.在单稳态触发器
