digitallogic第9讲

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1、习题参考答案2-17计算时，可以考虑输出低电平，也可以忽略。R≈600Ω盛建伦jlsheng@qtech.edu.cn12-13习题参考答案ABFAB1FAB2FABAB3FABAB4FAB5盛建伦jlsheng@qtech.edu.cn2数字逻辑DigitalLogic广义双语教学课程青岛理工大学课程网站211.64.192.58盛建伦jlsheng@qtech.edu.cn3第4章时序逻辑电路SequentiallogicCircuits(1)Indigitalcircuits,aflip-flopisatermreferringtoanelec

2、troniccircuitthathastwostablestatesandtherebyiscapableofservingasonebitofmemory.盛建伦jlsheng@qtech.edu.cn44.2触发器Flip-flops功能：用于记忆1位二进制信号1.有两个能自行保持的稳定状态，可分别表示0和1；2.根据不同的输入信号可以置成0或1。分类1.按触发方式（电平触发，脉冲触发，边沿触发）；2.按逻辑功能（RS,JK,D,T）。Flip-flopscanbeeithersimple(transparent)orclocked.Simpleflip-flopscan

3、bebuiltaroundapairofcross-coupledinvertingelements:vacuumtubes,bipolartransistors,fieldeffecttransistors,inverters,andinvertinglogicgateshaveallbeenusedinpracticalcircuits—perhapsaugmentedbysomegatingmechanism(anenable/disableinput).盛建伦jlsheng@qtech.edu.cn54.2.1基本RS触发器SRFlip-flopRS锁存器SRlatch

4、Set：置位，置1电路结构Reset：复位，置0RSQDQSRDQThefundamentallatchisthesimpleSRflip-flop,whereSandRstandforsetandreset,respectively.Itcanbeconstructedfromapairofcross-coupledNANDorNORlogicgates.盛建伦jlsheng@qtech.edu.cn6RS锁存器SRlatch工作原理现态次态两个或非门接成反馈,引出输入端用来置0，1nn1SRQQ定义：Q1,Q0为“1”状态DD0000保Q0,Q1为“0”状态001

5、1持RD为置0输入端1001S为置1输入端1011D0100Q根据工作原理得到特性表0110n1S和R的“1”信号同时消失后，Q不定1100*DD所以正常工作下，应遵循SR0的约束条件。1110*DDSD=1，RD=0置1SD=RD=0保持RD=1，SD=0置0SD=RD=1锁存器为非法状态，现态次态nn1SRQQDDQQ1000110000保00011持00111001100Q1011Q0100S、R同S、R同时0110时为1从1变01100*QSD0001110*不定RD00Q0QQ进入不定状态8RS锁存器SRlatch特性表用与非门构成的RS锁存器SRQnQn1D

6、D1100保SQSDSQ1111持D0101RRQRQD0111D100010100001*不0011*定n1S和R的“0”信号同时消失后，Q不定DD所以正常工作下，应遵循SR0的约束条件。DD9RS锁存器SRlatch动作特点：在任何时刻，SD输入都能直接改变输出的状态。R例：DSQQDRQQDS和R同时为0Q,Q同为1DD23:26:44盛建伦jlsheng@qtech.edu.cn10电平触发的触发器4.2.2同步RS触发器电路结构与工作原理1Q保持01QSD输入控制门基本RS锁存器Q1只有触发信号CLK到达，RQDS和R才起作用。电平触发的触发器nn1CLKS

7、RQQ同步RS锁存器0XX000XX1110000Q100111100111011Q101001011011101*Thenameflip-flopwaslaterderivedfromthe11111*soundproducedonaspeakerconnectedtooneoftheback-coupledamplifiersoutputsQduringthetriggerprocesswithinthecircuit.QS=1，R=0置1S=R=0保持R=1，S=0置0S=R=1触发器