EDA技术应用 龚江涛电子教案项目三 数码管显示译码器.ppt

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1、《EDA技术应用》项目课件项目六数码管显示译码器的VHDL设计一、项目描述抢答器LED数码管是目前常用的一种数显器件。使用是让某些笔段上的发光二极管发亮，即可组成0-9、A、b、C、d、E、F一系列数字或符号。LED数码管分共阳极与共阴极两种。数码管的应用十分广泛，凡是需要指示或读数的场合（如秒表、数字时钟、频率计等等）均可采用数码管显示。本项目是设计一个7段数码管显示译码器，使数码管可显示0-9、A、b、C、d、E、F，并通过4位拨码开关（SWD1～SWD4）输入、输出到数码管验证其功能。1.项目任务一、项目描述2.项目目标序号类别目标一知识了解硬件描述语言的发展概况了解VHDL

2、的程序特点及基本结构掌握VHDL的数据对象、数据类型、属性及运算符掌握VHDL并行语句的使用二技能掌握QuartusII软件的VHDL设计方法掌握VHDL语言的规范化编程能利用VHDL并行语句设计组合逻辑电路学习开发板的调试三职业素养学生的沟通能力及团队协作精神良好的职业道德质量、成本、安全、环保意识设计的规范性二、项目资讯VHDL概述概述VHDL的程序基本结构标识符、数据对象、数据类型、属性及运算符并行（并发）语句（ConcurrentStatements）（参见专题课件相应内容）四项内容三、项目分析1.系统功能分析7段数码管译码器是典型的组合逻辑电路思路分析：对于采用VHDL语

3、言设计简单组合逻辑，通常先列出真值表，再用VHDL语言的条件或选择语句将输入输入一一列举出来。三、项目分析2.硬件电路设计数码管显示译码器完全由CPLD内部电路实现4位输入可连接到4位拨码开关、7位输出连接到数码管的码段上。三、项目分析3.软件设计思路根据七段数码管译码器功能，列出真值表，可采用VHDL语言中并行条件赋值或者选择赋值语句来实现。输入端输出端数码管显示值输入端输出端数码管显示值ABCDabcdefghABCDabcdefgh0000111111000100011111110800010110000011001111011109001011110010210100011

4、1110A0011111100103101101111010B0100011001104110010011100C0101101101105110101111010D0110101111106111010011110E0111111000007111110001110F三、项目分析VHDL源程序--******************************************************--seg7.vhdlibraryieee;useieee.std_logic_1164.all;useieee.std_logic_arith.all;useieee.std_l

5、ogic_unsigned.all;--**********************************************entityseg7isport(swd:instd_logic_vector(3downto0);--BCD码输入seg:outstd_logic_vector(7downto0)--数码管7段输出);endseg7;--**********************************************architectureaofseg7isbeginwithswdselectseg<="11111100"when"0000","0110

6、0000"when"0001","11011010"when"0010","11110010"when"0011","01100110"when"0100","10110110"when"0101","10111110"when"0110","11100000"when"0111","11111110"when"1000","11110110"when"1001","11101110"when"1010","00111110"when"1011","10011100"when"1100","01111010"when"1101","10011110"when"1110","1000

7、1110"when"1111","00000000"whenothers;enda;四、项目实施微机一台（WindowsXP系统、安装好QuartusⅡ5.0等相关软件）EDA学习开发板一块USB电源线一条ISP下载线一条。硬件平台准备四、项目实施——1.QuartusⅡVHDL设计输入法(1)创建工程在D:alteraQuartus50exampleseg7下建立项目seg7选择EPM240T100C5作为目标器件四、项目实施——1.QuartusⅡVHDL