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时间:2017-05-06
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1、《数字电路与逻辑设计》习题答案一、填空1.(51.625)10=(110011.101)2=(33.A)162.(110101.1011)2=(35.B)163.(1997)10=(0100110011001010)余3BCD=(0001100110010111)8421BCD4.(011010011000)8421BCD=(689)10(011010011000)余3BCD=(365)105.(BF.5)16=(10111111.0101)26.16;67.4位8.除2取余法,乘2取余法9.1×23+0×22+1×21+1×20+0×2-
2、1+1×2-210.2i,Ni11.奇校验码12.1,113.与、或、非14.逻辑式、真值表、逻辑图15.输出值“1”的对应最小项相加16.三进制及三进制以上进制的算术加,二进制算术加,逻辑加,模2加17.2n18.相邻码组之间只有一位不同19.n个相领项20.开通,延迟,上升,tON=td+tr21.关闭,存储,下降,tOFF=ts+tf22.从负载流(灌)入反相器(或与非门),低23.从反相器(或与非门)流(拉)到负载,高24.与非门允许多大的噪声电压叠加到输入信号的高、低电平上,而不致破坏其正常逻辑状态,抗干扰能力越强25.最多可以带
3、动10个同类型门电路。26.tPHL,tPLH,(tPHL+tPLH)/227.短接,短接F1•F2,线与28.“0”,“1”,“高阻”29.PMOS,NMOS,CMOS反相器,PMOS,NMOS,CMOS传输门30.VD+0.7V,-0.7V,极小,激增31.数字,模拟32.电路功耗低、抗干扰能力强、集成度高等3133.VNL=ViL(max)-VoL(max)34.电路任一时刻的输出仅取决于该时刻的输入状态,而与电路前一时刻的状态无关35.只包含门电路(无存储元件)≥136.37.确定它的逻辑功能,并加以改进38.两数的本位加,不带低位
4、的进位加,带进位加39.16个,低电平“0”,高电平“1”40.它们都有两个稳态,可以触发翻转,故具有记忆能力41.特性表、特性方程、波形图42.D、T'、T、RS、JK43.可以用CP控制其翻转时刻,同步触发器、主从触发器、边沿触发器,电平触发、主从触发、边沿触发44.主从、边沿触发器可以克服空翻,而同步触发器不能克服空翻45.两门之间因交叉耦合而产生的自锁作用46.RS=0,R、S不能同时为“1”47.0,148.可控制的计数,计数翻转,保持原状态49.下降,上升,150.边沿触发方式51.同步时序电路,异步时序电路52.触发器53.统
5、计计数脉冲个数54.Qi-1Qi-2‥‥‥Q1Q0,Qn-1Qn-2‥‥‥Q1Q055.暂存,平移56.串/并转换57.16μS58.波形变换、整形、脉冲鉴幅二、选择题:1.AD2.BCD3.AB4.D5.C6.ABD7.D.8.C9.B10.D3111.B12.A.13.B14.AB三、化简下列各题1.用代数法化简下列函数为最简与或表达式(1)F=B+B+AC=B(+)+AC=B+AC=B+AC(2)F=+CD+D+C=(+D)+(CD+C)=+C=1(3)F=AB+AB+C+AC=AB+C+AC=AB+C(4)F=A++=A+BCD+A
6、D+B=A+B2.将下列函数式化为最小项表达式(1)F=AB+BC+AC=AB(C+)+(A+)BC+A(B+)C=ABC+AB+BC+AC(2)F==AB+BC=AB(C+)+(A+)BC=ABC+AB+BC3.用代数法证明下列等式(1)左式=(A+B)+(CD+C)+=A+B+D++31=A+B+D++=1(1)A⊕0=A·+·1=A(2)A⊕1=A·+·1=(3)A⊕=A·+·=A+=11.直接写出下列各函数的对偶式F',并用反演规则写出其反演式(1)F'=(A+)(B+)(C+D)=(+B)(+C)(+A)(2)F'=A·=·2.用
7、对偶规划求下列各式的对偶等式(1)左式的对偶式为(A+B)(+C)(B+C+D)右式的对偶式为(A+B)(+C)∴其对偶等式为:(A+B)(+C)(B+C+D)=(A+B)(+C)(根据对偶规则两式相等,则其对偶式也相等)(2)左式的F'1=右式的F'2=++其对偶等式为:31=++1.试写出下列卡诺图的最小项表达式,并用卡诺图法求其最简与或式(1)最小项表达式F(A、B、C)=或F=+C+BC+A+AC最简与或式F=C+(2)最小项表达式F(A、B、C、D)=或F=+C+B+BC+A+AC;最简与或式F=+2.用卡诺图法化简下列函数为最简
8、与或式(1)F=C+AD+(B+C)+A+=A+C+31(2)F==A+C++CD9.(1)错(2)错(3)对10.11.控制信号输出变量BCY0Y1Y2Y30001A0A1A2
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