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1、第14章双稳态触发器与 时序逻辑电路14.1双稳态触发器14.2寄存器14.3计数器数字电路组合逻辑电路时序逻辑电路由逻辑门组成由触发器组成输出信号随着输入信号消失输出信号没有消失。具有记忆功能！返回14.1双稳态触发器双稳态触发器的输出状态为0或1；输出状态不仅和现时的输入有关，还与原来的输出状态有关；双稳态触发器具有记忆功能。目前常用的有R-S触发器、D型触发器、J－K触发器等。双稳态触发器的内部由逻辑门组成。返回14.1.1R-S触发器1.基本R-S触发器反馈线两个输入端两个输出端，状态相反。负脉冲低电平使触发器输出0或1。逻辑功能分析：设原
2、状态：0101110输出仍保持：0返回设原状态：1001110输出变为：RD=0,SD=1时,不论原来状态如何，Q=0。0返回设原状态：0110011输出变为：0返回设原状态：1010011输出仍为：0RD=1,SD=0时,不论原来状态如何，Q=1。返回设原状态：011110输出仍为：100返回设原状态：101101输出仍为：011RD=1,SD=1时,Q保持原来状态不变。返回设原状态：01001输出全为1，实际工作中这是不允许出现的！因为，当RD、SD的低电平信号消失后，输出端的状态不能确定。1当RD=SD=0同时变为1时，翻转快的门输出变为0，
3、另一个不翻转。例如，B门翻转快...11001返回真值表:1101010100不定同时变1后输出状态不能确定。置1端置0端基本R-S触发器是其它触发器组成的一部分，其作用是预置其它触发器的初始状态。返回2.可控R－S触发器由基本R－S触发器外加两个导引门和时钟脉冲控制端组成。直接置0端或置1端时钟脉冲控制端C=0时，触发器状态不变；C=1时，触发器状态由输入信号决定。时钟脉冲的控制作用：返回逻辑功能分析：设原状态：C=0时，触发器状态不变。1101由置0端加负脉冲实现。1C=1时，触发器状态由R和S决定。1010110R=0,S=1时,Q＝1。01
4、返回设原状态：0111010110R=1,S=0时,Q＝0。1C=1时，触发器状态由R和S决定。返回设原状态：011001110R=0,S=0时,Q＝0不变。1C=1时100返回C=1时，R=0,S=0时,Q＝1不变。101001111010设原状态：1R=0,S=0时,不论原来状态如何，Q保持不变。返回设原状态：01111001R=1,S=1时,Q的状态不定。1C=1时1返回真值表:1100000111不定禁态，时钟脉冲消失后，输出状态不能确定。置1端置0端前沿触发可控R－S触发器虽然结构简单，但是组成计数器时存在空翻，因此不常用。返回14.1.
5、2J-K触发器主从型J－K触发器是由两个可控R－S触发器外加一个非门组成。其中F1和F2为R—S触发器。主触发器从触发器时钟脉冲反馈线返回功能分析：时钟没来之前，首先将触发器置0，即C=0时,主触发器不工作，从触发器工作，接收信息。0C=1时，主触发器工作，从触发器不工作；01001返回（1）J=1,K=00当C=1时，主触发器工作，从触发器不工作；1010001返回（1）J=1,K=00101010当C=0时，主触发器不工作，从触发器工作；接收信息。011后沿返回（2）J=1,K=10当C=1时，主触发器工作，从触发器不工作；1110001返回（
6、2）J=1,K=10111010当C=0时，主触发器不工作，从触发器工作；接收信息。011后沿返回（2）J=1,K=11当C=1时，主触发器工作，从触发器不工作；1110110返回（2）J=1,K=111110110当C=0时，主触发器不工作，从触发器工作；接收信息。010由上分析可见：当J=1，K=1时，在时钟脉冲的后沿来到时，触发器翻转，原来是0就翻成1，原来是1就翻成0。返回真值表真值表和逻辑符号逻辑符号应用：组成分频器、寄存器和计数器。触发器后沿翻转返回CKJ【例14.1】已知J－K触发器的输入波形如图所示，试画出的波形。返回【例14.2】
7、已知J－K触发器如图所示，试画出在时钟脉冲的作用下，输出端Q的波形。解J-K触发器接成计数状态，组成2分频器。返回14.1.3D触发器为了解决空翻问题，由六个与非门组成维持阻塞型D触发器，逻辑电路如图所示。&e&f&c&d&a&bDC逻辑符号触发器前沿翻转一个输入端返回其翻转过程请自行分析。真值表D触发器的输出状态随着输入状态变化。返回CD【例14.3】画出D触发器的输出波形。返回【例14.4】画出D触发器的输出波形。解(74LS73)J-K触发器的管脚图(74LS74)D触发器的管脚图返回14.2寄存器寄存器：数码寄存器和移位寄存器。寄存器的组成
8、：触发器及其附加逻辑门。寄存数码的位数：n个触发器可以寄存n位数码。寄存数码的输入方式：并行输入与串行输入。寄存数码的输出
