好使_集成触发器.ppt

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1、一、触发器的基本特性和作用Flip-Flop，简写为FF，又称双稳态触发器。基本特性(1)有两个稳定状态(简称稳态)，正好用来表示逻辑0和1。(2)在输入信号作用下，触发器的两个稳定状态可相互转换。输入信号消失后，新状态可长期保持下来，因此具有记忆功能，可存储二进制信息。一个触发器可存储1位二进制数码第九章集成触发器触发器的作用触发器有记忆功能，由它构成的电路在某时刻的输出不仅取决于该时刻的输入，还与电路原来状态有关。触发器和门电路是构成数字电路的基本单元。门电路无记忆功能，由它构成的电路在某时刻的输出完全取决于该时刻的输入，与电路原来状态无关；二、触发器的类型根据逻辑功能不同分为

2、:RS触发器D触发器JK触发器T触发器T触发器根据触发方式不同分为:电平触发器边沿触发器主从触发器根据电路结构不同分为:基本RS触发器同步触发器主从触发器边沿触发器三、触发器逻辑功能的描述方法主要有特性表、特性方程、驱动表(又称激励表)、状态转换图和波形图(又称时序图)等。主要要求：掌握与非门结构基本RS触发器的电路、逻辑功能和工作特点。9.1基本RS触发器掌握触发器的0态、1态、置0、置1、触发方式、现态、次态和空翻等概念。了解触发器逻辑功能的描述方法。返回(一)由与非门组成的基本RS触发器1.电路结构及逻辑符号QQSDRDG1G2QQSDRDSRSDRDQQQ=1，Q=0时，

3、称为触发器的1状态，记为Q=1；Q=0，Q=1时，称为触发器的0状态，记为Q=0。RDSD置0端，也称复位端。R即Reset置1端，也称置位端。S即SetBasicFlip-Flop信号输入端互补输出端，正常工作时，它们的输出状态相反。低电平有效一、基本RS触发器QQSDRDG1G211011000SDRD功能说明输入QQ输出2.工作原理及逻辑功能011110触发器被置0触发器置010工作原理2.工作原理及逻辑功能QQSDRDG1G211011000SDRD功能说明输入QQ输出100111触发器被置1触发器置010触发器置1012.工作原理及逻辑功能QQSDRDG1G211011

4、000SDRD功能说明输入QQ输出11触发器置010触发器置101触发器保持原状态不变不变&&G1门输出G2门输出2.工作原理及逻辑功能QQSDRDG1G2输出状态不定(禁用)不定11011000SDRD功能说明输入QQ输出触发器置010触发器置101触发器保持原状态不变不变0011输出既非0状态，也非1状态。当RD和SD同时由0变1时，输出状态可能为0，也可能为1，即:输出状态不定。这种情况禁用。特性表3.逻辑功能的特性表描述次态现态指触发器在输入信号变化前的状态，用Qn表示。指触发器在输入信号变化后的状态，用Qn+1表示。触发器次态与输入信号和电路原有状态之间关系的真值表。基本

5、RS触发器工作原理动画演示00001×触发器状态不定0×1010100触发器置000101101触发器置1111110011触发器保持原状态不变说明Qn+1QnSDRD基本RS触发器特性表的简化表示Qn11101010不定00Qn+1SDRD与非门组成的基本RS触发器特性表置0端RD和置1端SD低电平有效。禁用RD=SD=0。称约束条件注意波形分析举例解：[例]设下图中触发器初始状态为0，试对应输入波形画出Q和Q的波形。QQSDRDSRSDRD保持初态为0，故保持为0。置0保持QQ置1(二)基本RS触发器的两种形式特性表Qn11101010不定00Qn+1SDRD不定1100111

6、0Qn00Qn+1SDRDQQSDRDSRQQSDRDSR逻辑符号置0、置1信号低电平有效置0、置1信号高电平有效注意弄清输入信号是低电平有效还是高电平有效。(三)基本RS触发器的优缺点优点缺点电路简单，是构成各种触发器的基础。输出受输入信号直接控制，不能定时控制。2.有约束条件。返回主要要求：9.2几种常用的同步触发器了解同步触发器的结构、工作特点和存在问题。掌握RS触发器、D触发器、JK触发器的逻辑功能及其特性方程。返回同步触发器SynchronousFlip-Flop实际工作中，触发器的工作状态不仅要由触发输入信号决定，而且要求按照一定的节拍工作。为此，需要增加一个时钟控制端

7、CP。CP即ClockPulse，它是一串周期和脉宽一定的矩形脉冲。具有时钟脉冲控制的触发器称为时钟触发器，又称钟控触发器。同步触发器是其中最简单的一种，而基本RS触发器称异步触发器。(一)同步RS触发器QQG1G2SRG3G4CPQ3Q4工作原理★CP=0时，G3、G4被封锁，输入信号R、S不起作用。基本RS触发器的输入均为1，触发器状态保持不变。★CP=1时，G3、G4解除封锁，将输入信号R和S取非后送至基本RS触发器的输入端。0111SR1.电路结构与工作原理基