专业培训总结!.pdf

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1、2：部门培训：通过部门培训，我比较系统的学习了Allegro软件的常规操作以及PCB的基本知识。在试用期间我总共完成了9块练习板，其中包括5块单板，4片模块练习板，现在我将我所学习的东西做成以下表格报告：表一：DVI_DEBUG单板设计板名时间布局、布线要求注意事项总结心得体会1：严格按照参考板1：在设计中严格通过这块练习板地学习使我上的设计进行布在格点上打孔：对PCB板有了一个比较理性局；的认识，知道了一块好的PCB2：在学习中要注DVI_DEBU板不是想象中的那么简单，两周2：在练习版的设计意对命令的学习G初期学习由于对命令不熟中不能出现走线锐悉，在老师讲解时

2、没有及时角的情况。做好笔记，导致后期设计某项规则是无法操作。表二：DDR2×2模块练习设计板名时间布局、布线要求注意事项总结心得体会1：两片DDR2对称布1：DDR2的线为高速在设计初期由于对DDR2局，滤波电容就近管脚信号线，因此要做等的理解不够深刻，参考电放置;长，其中地址线，时压VREF的连线不是特别2:地址线，时钟线，控钟线，控制线误差控熟悉,没有加粗到制线走T型拓扑结构，制范围在+/-100mil,20-30mil,当时也并不知道DDR2×2一周数据线走尽量同层，为数据线则控制在串扰这个概念，信号线的点到点结构。+/-15mil,时钟差分对间距没有严格按

3、照3W原内严格控制在+/-5mil则走线，因此在今后的做之内板中要注意及时设好线距规则。表三：DDR3模块练习设计板名时间布局、布线要求注意事项总结心得体会1：布局结构与DDR21：DDR3的差分线等此板主要练习从BGA内出基本类似；长公差为+/-5mil数据线和等长练习，BGA芯片较难2：DDR3与DDR2的线为+/-10mil，地址线出线，因此BGA的第一排和第地址拓扑结构一样，为+/-100mil。地址线二排引脚尽量不要打孔，直接但是其速率更高，在走菊花链拓扑时走线从表层出线。另外当时拉线时DDR3一周信号完整性上走菊花越短越好。数据线没有一组一组的连接，链

4、更好，因此采用走2：差分线与其他信号后期绕等长时才发现有根数据菊花链结构线的间距为20mil。线忘记连接，而此时空间已经非常窄，因此今后同种信号线一定要同时把飞线打开。表四：1183SCH模块布局练习设计板名时间布局、布线要求注意事项总结心得体会1：布局时的元器件1：晶体,无源，尽量TOP在进行模块布局时经常忘摆放顺序是晶体晶层布局，紧靠相关IC；电记的是器件间的距离，往往振然后是滤波电路结构应包地处理；晶体忽略此项的检查，还有晶体路，接着是端接电下方不能走线。输出时钟的加粗包地处理，应此在今1183SC阻，最后是上下拉线一般加粗道8-10mil。后的模块布局时就

5、要处理一周H电阻；2：晶振,有源，尽量TOP好这些东西，不要想着最后2：BGA等大芯片的层布局；在输入端要分清统一处理，这样容易遗忘。电源去耦电容应就电源端和使能端，滤波电在塞电容时做到电源地的近管脚摆放。容采用π型滤波，电容应三个管脚不能共用。先大后小。表五：电源模块布局练习设计板名时间布局、布线要求注意事项总结心得体会1:常规电源模块滤1：在进行设计时一定要分在进行电源模块布局时经波电容应遵循输入清电源模块的输入，输出常忘记加粗处理；布局后由输出都先大后小的的主干道；于没有查看芯片手册上的顺序；2：开关电源模拟地要进行电流大小，导致铜箔和过孔2：严格按照原理图

6、单点接地，以及所有线的的载流能力不够，设计初期PWR一周顺序摆放器件，布加粗处理，布局时最好按经常忘记电容地信号地就局是应查看电源芯一字型或L型布局近打孔，这些都是设计时不片数据手册，依据3：开关电源IC以及电感够细心造成的，因此在今后手册推荐进行布局下方不能走线。的单板电源设计时要牢记设计原则。表六：ADboard单板练习设计时间板名布局、布线要求注意事项总结心得体会/PIN1:此板为数模混1：此板为整版练习，比较板地练习设计，我对做合板，布局中要难把握模块位置的放置，整版上的布局思路有了很区分开数字与模因此在放置元器件的时候大的提高，但是设计初期没拟信号，对其

7、进要特别注意IC器件的放有画出树形结构图，导致后一周/行分块布局；置，让心中有个大概的方期对电流大小以及流向不ADboard2：在进行电源分向；清楚，在分割电源时耗费了1700PIN割时两种电源要2：布局中插件元器件背面一定的时间，另外一些器件严格分开，以防不要放置贴片器件间的距离没有把握准确，后止容性耦合期走线完毕才检查，导致模块的调整特别费力。表七：LCDTV-board单板练习设计板名时间/PIN布局、布线要求注意事项总结心得体会1:此板常用接口1:在高速接口上常常忘通过LCD板地练习，使我在整比较多，在布局记进行包地处理或者是板协调设计上有了很大的提时要考

8、虑信号的包