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时间:2019-09-09
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1、EDA技术实用教程第4章QuartusII应用向导4.1基本设计流程4.1.1建立工作库文件夹和编辑设计文件⑴新建一个文件夹⑵输入源程序⑶文件存盘4.1基本设计流程4.1.1建立工作库文件夹和编辑设计文件⑴新建一个文件夹⑵输入源程序⑶文件存盘4.1基本设计流程4.1.2创建工程⑴打开并建立新工程管理窗口4.1基本设计流程4.1.2创建工程⑵将设计文件加入工程中4.1基本设计流程4.1.2创建工程⑶选择目标芯片4.1基本设计流程4.1.2创建工程⑷工具设置⑸结束设置4.1基本设计流程4.1.3编译前设置⑴选择FPGA目
2、标芯片⑵选择配置器件的工作方式4.1基本设计流程4.1.3编译前设置⑶选择配置器件和编程方式⑷选择目标器件引脚端口状态⑸选择确认VHDL语言版本4.1基本设计流程4.1.4全程编译4.1基本设计流程4.1.5时序仿真⑴打开波形编辑器4.1基本设计流程4.1.5时序仿真⑵设置仿真时间区域⑶波形文件存盘4.1基本设计流程4.1.5时序仿真⑷将工程CNT10的端口信号节点选入波形编辑器中4.1基本设计流程4.1.5时序仿真⑷将工程CNT10的端口信号节点选入波形编辑器中4.1基本设计流程4.1.5时序仿真⑸编辑输入波形(输
3、入激励信号)4.1基本设计流程4.1.5时序仿真⑹总线数据格式设置和参数设置4.1基本设计流程4.1.5时序仿真⑹总线数据格式设置和参数设置4.1基本设计流程4.1.5时序仿真⑹总线数据格式设置和参数设置4.1基本设计流程4.1.5时序仿真⑺仿真器参数设置4.1基本设计流程4.1.5时序仿真⑻启动仿真器⑼观察仿真结果4.1基本设计流程4.1.6应用RTL电路图观察器4.2引脚设置与硬件验证4.2.1引脚锁定4.2引脚设置与硬件验证4.2.1引脚锁定4.2引脚设置与硬件验证4.2.1引脚锁定4.2引脚设置与硬件验证4.
4、2.1引脚锁定4.2引脚设置与硬件验证4.2.2编译文件下载4.2引脚设置与硬件验证4.2.2编译文件下载4.2引脚设置与硬件验证4.2.2编译文件下载4.2引脚设置与硬件验证4.2.3AS模式编程4.2.4JTAG间接模式编程配置器件1.将SOF文件转化为JTAG间接配置文件4.2引脚设置与硬件验证4.2引脚设置与硬件验证4.2引脚设置与硬件验证4.2.4JTAG间接模式编程配置器件1.将SOF文件转化为JTAG间接配置文件4.2引脚设置与硬件验证4.2.4JTAG间接模式编程配置器件2.下载JTAG间接配置文件4
5、.2引脚设置与硬件验证4.2.5USB-Blaster编程配置器件使用方法4.2.6其他的锁定引脚方法4.2引脚设置与硬件验证4.2.6其他的锁定引脚方法4.3嵌入式逻辑分析仪使用方法1.打开SignalTap II编辑窗口4.3嵌入式逻辑分析仪使用方法2.调入待测信号4.3嵌入式逻辑分析仪使用方法2.调入待测信号4.3嵌入式逻辑分析仪使用方法3.SignalTapII参数设置4.3嵌入式逻辑分析仪使用方法4.文件存盘4.3嵌入式逻辑分析仪使用方法5.编译下载4.3嵌入式逻辑分析仪使用方法6.启动SignalTap
6、II进行采样与分析4.3嵌入式逻辑分析仪使用方法6.启动SignalTap II进行采样与分析7.SignalTapII的其他设置和控制方法4.4编辑SignalTapII的触发信号4.4编辑SignalTapII的触发信号4.4编辑SignalTapII的触发信号4.5原理图输入设计方法4.5.1层次化设计流程1.为本项工程设计建立文件夹2.建立原理图文件工程和仿真4.5原理图输入设计方法4.5.1层次化设计流程2.建立原理图文件工程和仿真4.5原理图输入设计方法4.5.1层次化设计流程2.建立原理图文件工程和仿真
7、4.5原理图输入设计方法4.5.1层次化设计流程2.建立原理图文件工程和仿真4.5原理图输入设计方法4.5.1层次化设计流程3.将设计项目设置成可调用的元件4.5原理图输入设计方法4.5.1层次化设计流程4.设计全加器顶层文件4.5原理图输入设计方法4.5.1层次化设计流程4.设计全加器顶层文件4.5原理图输入设计方法4.5.1层次化设计流程4.设计全加器顶层文件4.5原理图输入设计方法4.5.1层次化设计流程5.将设计项目进行时序仿真4.5原理图输入设计方法4.5.2应用宏模块的多层次原理图设计1.计数器设计(1)
8、设计电路原理图(2)建立工程4.5原理图输入设计方法(2)建立工程4.5原理图输入设计方法(3)系统仿真(4)生成元件符号4.5原理图输入设计方法2.频率计主结构电路设计4.5原理图输入设计方法2.频率计主结构电路设计4.5.2应用宏模块的多层次原理图设计4.5原理图输入设计方法3.时序控制电路设计4.5.2应用宏模块的多层次原理图设计4.5原
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