eda实验报告5 计数器设计

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1、EDA实验5计数器设计一、实验目的计数器是实验中最为常用的时序电路模块之一，本实验的主要目的是掌握使用HDL描述计数器类型模块的基本方法。二、实验仪器1.EDA开发软件一套2.微机一台3.实验开发系统一台三、实验说明计数器是数字电路系统中最基本的功能模块之一，设计时可以采用原理图或HD语言完成。下载验证时的计数时钟可选用连续或单脉冲，并用数码管显示计数值。四、实验要求1．设计一个带有计数允许输入端、复位输入端和进位输出端的十进制计数器。2．编制仿真测试文件，并进行功能仿真。3．下载并验证计数器功能。

2、4．为上述设计建立元件符号。五、实验过程1.源程序LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYcounterISPORT(CLK,RST,EN:INSTD_LOGIC;CQ:OUTSTD_LOGIC_VECTOR(3DOWNTO0);COUT:OUTSTD_LOGIC);ENDcounter;ARCHITECTUREbehaveOFcounterISBEGINPROCESS(CLK,RST,E

3、N)VARIABLECQI:STD_LOGIC_VECTOR(3DOWNTO0);BEGINIFRST='1'THENCQI:=(OTHERS=>'0');ELSIFCLK'EVENTANDCLK='1'THENIFEN='1'THENIFCQI<"1001"THENCQI:=CQI+1;ELSECQI:=(OTHERS=>'0');ENDIF;ENDIF;ENDIF;IFCQI="1001"THENCOUT<='1';ELSECOUT<='0';ENDIF;CQ<=CQI;ENDPROCESS;E

4、NDbehave;2．实验结果