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时间:2019-08-04
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1、领步电气VerilogHDL代码规范FPGA组VerilogHDL代码规范(仅内部使用)文档作者:冯仁委日期:2013-8-5审批:日期:领步电气VerilogHDL代码规范内部公开修订记录日期修订版本描述作者2013-8-51.00初稿完成冯仁委2013-08-05版权所有侵权必究2领步电气VerilogHDL代码规范内部公开目录VerilogHDL代码规范.....................................................................
2、.................................................1修订记录...........................................................................................................................................2目录......................................................
3、............................................................................................31.目的...........................................................................................................................................42.范围.........
4、..................................................................................................................................43.定义...................................................................................................................
5、........................44.规范内容...................................................................................................................................41)可综合设计................................................................................
6、.......................................4a)命名规范...................................................................................................................4b)模块规范..................................................................................
7、.................................7c)NetandRegister......................................................................................................12d)Expressions...................................................................................
8、...........................13e)For语句..................................................................................................................13f)If语句............................................................................................
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