EDA期末知识整理

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1、一关系混淆类概念1简述VHDL语言实体声明中：IN，OUT，BUFFER和INOUT等端口模式各自的特点。端口模式特点为：IN：输入型，只读模式。OUT：输出型，只写。BUFFER：缓冲型，带有读功能的输出模式，即输出并向内部反馈，与out相似，但可读。INOUT：输入输出型，可读可写，可以通过该端口读入或写出信息。2简述VHDL中信号、变量的功能特点及使用方法，区别。答：信号：代表电路中的某一条硬件连接线，包括输入、输出端口，信号赋值存在延迟。全局量，使用场所：architecture、package、entitiy。变量：代表电路中暂存某些值的载

2、体。变量赋值不存在延迟。局部量，使用场所：process、function、procedure。信号变量赋值符号<=:=功能电路的内部连接内部数据交换作用范围全局，进程和进程之间的通信进程的内部行为延迟一定时间后才赋值立即赋值3VHDL的基本结构及每部分的基本功能？答：VHDL的基本结构有：库（Library）、程序包（Package）、实体（Entity）、结构体（Architecture）和配置（Configuration）几部分组成。每部分的基本功能为：库（Library）：用来存储预先完成的程序包和数据集合体的仓库。以供设计者对一些统一的语言

3、标准或数据格式进行调用。程序包（Package）：将已定义的常数、数据类型、元件语句、子程序说明等收集起来构成一个集合。实体（Entity）：定义系统的输入输出端口结构体（Architecture）：定义系统的内部结构和功能。配置（Configuration）：从某个实体的多种结构体描述方式中选择特定的一个作为实体的实现方式。4试比较case语句和with-select语句的区别case语句with_select语句不同点：顺序执行语句并行执行语句只能在process中或子程序中不能在process或子程序中二名词解释和基本概念：ASIC专用集成电路

4、，FPGA现场可编程门阵列CPLD复杂的可编程逻辑器件，IP知识产权核或知识产权模块JTAG联合测试行动小组HDL硬件描述语言VHDL超高速集成电路硬件描述语言SOPC：可编程片上系统PCB：(ProcessControlBlock)进程控制块RTL：寄存器传输级FSM：有限状态机LPM：可设置模块库IEEE电子电气工程师协会LPM参数可定制宏模块库UART串口（通用异步收发器）ISP在系统编程LAB逻辑阵列块可编程器件分为FPGA和CPLDFPGA结构一般分为三部分：可编程逻辑块（CLB）、可编程I/O模块和可编程内部连线。FPGA过程中的仿真有三

5、种：行为仿真、逻辑仿真、时序仿真图形文件的扩展名是GDF，仿真通道文件的扩展名是SCF，波形文件的扩展名是WDF，使用VHDL语言，文本设计文件的扩展名是.VHDMAX＋PLUSII支持的设计输入方法有图形输入，波形输入，文本输入QuartusII有原理图、文本、波形三种输入方式EDA设计输入主要包括 图形输入     HDL文本输入      状态机输入 MAX+PLUS2的VHDL程序的文件名和实体名要一致。表示端口映射的关键词是PORTMAP。基于EDA软件的FPGA/CPLD设计流程为：原理图/HDL文本输入→功能仿真→综合→适配→时序仿真→

6、编程下载→硬件测试。基于可编程器件EDA技术主要包括四大要素，分别为大规模可编程器件、硬件描述语言、软件开发系统、实验开发系统。       EDA数字系统工程设计流程包括：设计准备、设计输入、设计实现、器件编程与配置、设计验证。EDA设计过程中的仿真有三种，它们是行为仿真、逻辑仿真和时序仿真以EDA方式设计实现的电路设计文件，最终可以编程下载到  FPGA 和  CPLD 芯片中，完成硬件设计和验证。EDA设计流程包括 设计输入 、  设计实现、 实际设计检验   和 下载编程 四个步骤。元件例化语句的作用：层次设计，由元件声明和元件例化两部分组成

7、。元件例化语句中的接口表达式有名称关联和位置关联两种方式。VHDL中元件例化语句的端口映射方式有名字映射和位置映射两种硬件描述语言(HDL)是EDA技术的重要组成部分，是电子系统硬件行为描述、结构描述、数据流描述的语言。它的种类很多，如VHDL、VerilogHDL、AHDL。硬件描述语言HDL给数字系统的设计带来了更新的设计方法和理念，产生了目前最常用的自顶向下的设计方法。变量赋值语句的语法格式：目标变量名：＝表达式，信号赋值语句的语法格式：目标信号名<=表达式。下列标准数据类型各值的含义：‘0’_强0__、‘1’_强1_、‘Z’高阻态、‘L’_弱

8、0__、‘H’__弱1__、‘－’_忽略___。CPLD是基于乘积项的可编程结构，即由可编程的与阵列和固定的