计数器讲课思路

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1、一、计数器讲课思路：所有计数器均由一般计数器改进而来1、一般计数器一一例:模16、32、64等模数为2"ENTITYwz6isPORT(clk:INStd_Logic;q:OUTStd_Logic_vector(3downto0));ENDwz6;ARCHITECTUREaOFwz6ISsignalq1:std_logic_vector(3downto0);BEGINprocess(clk)beginifclk'eventandelk-1'thenql<=ql+l;endif;q<=q1；endprocess;enda;整模：只改Q的数据宽度

2、如Q:outSTD_LOGIC_VECTOR(4downto0)、(5downto0)...2、任意模数IFCLK*EVENTANDCLK='I1THENIFQI二“”THENQlv=”00...0”；ELSEQlv二Ql+1;ENDIF;ENDIF;q<=q1；ENDPROCESS;3、带进位输出，实现任意固定分频IFCLKfEVENTANDCLK='VTHENIFQ1=“”THENQlv二“00...0”；cov二T；ELSEQ1<=Q1+1;co<=*0*;ENDIF;ENDIF;Q<=Q1；ENDPROCESS;4、数控分频数据输入端

3、：①脉冲CLK；②分频数设置端D,D是一个数组，具有一定宽度，宽度越大，可分频的灵活度越大。PORT(CLK:INSTD_LOGIC;D:instd_logic_vector(4downto0);co:outSTD_LOGIC;Q:outSTD_LOGIC_VECTOR(4downto0));ENDshiyan;ARCHITECTUREAOFshiyanISsignalQl:std」ogic_vector(4downto0);BEGINPROCESS(CLK)BEGINIFCLK*EVENTANDCLK二TTHENIFQI二DTHENQlv=

4、”00000”；cov二T;ELSEQ1<=Ql+l;co<='0,;ENDIF;ENDIF;q<=q1；ENDPROCESS;二.两个示例程序：LIBRARYIEEE;USEIEEE.STD_LOGIC_ARITH.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;USEIEEE.STD_LOGIC_1164.ALL;ENTITYshiyanISPORT(CLK:INSTD_LOGIC;co:outSTD_LOGIC;)；ENDshiyan;ARCHITECTUREAOFshiyanISsignalq1:std_logi

5、c_vector(4downto0);BEGINPROCESS(CLK)BEGINIFCLK'EVENTANDCLK二TTHENIFQKdTHENQ1<=Q1+1;co<='0,;ELSEQlv=“0000(T;cov=T;ENDIF;ENDIF;q<=q1；ENDPROCESS;ENDA;CLK田dB0B0001111J1J1J1。[0[1[2[3[4cQo-QQQ0011nnjiTLrJjuuiuuuo01111000D0riRmuuiwuuinjuumminjuifiRnmfuuuinwuuuiniwuw观察：当D=00000吋，CO=

6、1LIBRARYIEEE;USEIEEE.STD_LOGIC_ARITH.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;USEIEEE.STD_LOGIC_1164.ALL;ENTITYshiyanISPORT(CLK:INSTD_LOGIC;d:instd_logic_vector(4downto0);co:outSTD_LOGIC;Q:outSTD_LOGIC_VECTOR(4downto0));ENDshiyan;ARCHITECTUREAOFshiyanISsignalq1:std_logic_vector(4

7、downto0);BEGINPROCESS(CLK)BEGINIFCLKEVENTANDCLK二TTHENIFQl=dTHENQlv=”()()()()0”；cov二T;ELSEQK=Q1+I;co<='0';ENDIF;ENDIF;q<=q1；ENDPROCESS;ENDA;二JZCLKcoQ[0]BOOOllOCOllD』mmumilinnnnmiinnMMimiMMiraLmWWMILlM11101111ooooo_i_i__i_lj_lji_i__imBniiiraiimiBMQ[l)Q⑵Q⑶Q⑷B0B0B0B0juiwuuuuuui

8、njuuuuuuwwuLWMuwuwnuwuiwuuuuuuuuMinjwjwiminrLrLruinnjuuuuuwwuuuuuumruwuumruisii；；；