试卷_数字逻辑(09本科)a1

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1、电子科技大学中山学院考试试卷课程名称:数字逻辑设计及应用试卷类型：A卷2010—2011学年第二学期期末考试考试方式：闭卷拟题人：石建国日期：2011.6.8审题人：学院：电子信息学院班级：学号：姓名：题号一二三四五六七八九十总分得分一、填空题：（每空2分，共24分）1、十进制数-6的8位二进制补码为______________B。2、8421BCD码36H代表的十进制数为__________。3、根据逻辑代数中的摩根定理，ABC____________。4、n变量所有最小项的和为_____________________。5、ABC

2、BC________。6、三态门的三种输出状态分别为0态、1态和_________态。7、正逻辑中的与非门相当于负逻辑中的_____门。装订线内禁止答题8、多个CMOSOD门输出端并联再加公共上拉电阻后可实现__________功能。9、容量为16K×8bits的并行SRAM芯片具有______根地址线。10、锁存器是一种对________________敏感的存储单元电路。11、实现二十四进制计数器至少需要_______个触发器（如果要求用触发器实现的话）。12、74LS194为________________________芯片。二、逻辑

3、函数化简：（每小题6分，共12分）1、FBACABABCABC电子科技大学中山学院试卷第1页，共4页2、F(A,B,C,D)m)7,5,3,1,0(d,9(10,11,12,13,14,15)三、8选1数据选择器74HC151应用电路如下图所示，试用与非门实现其功能等效电路。（10分）四、试用74HC138译码器和与非门实现函数FABC。（10分）电子科技大学中山学院试卷第2页，共4页五、针对下图所示时序电路，画出在时钟CP作用下Q0、Q1、Q2输出波形（假设各输出端初始状态均为0）。（9分）六、对以下由JK触发器构成的时

4、序电路进行分析，列出其状态表并画出相应的状态图。(13分)电子科技大学中山学院试卷第3页，共4页七、试用4位二进制加法计数器74161设计一个模7计数器。（10分）附：74161引脚图及功能表CPCRPECEPCET工作状态×0×××清零↑10××置数×1101保持×11×0保持（且TC=0）↑1111计数八、试用VerilogHDL描述一个同步十进制加法计数器，其引脚和功能特性如下：（12分）CPCR工作状态×0清零↑1计数电子科技大学中山学院试卷第4页，共4页