09数字逻辑试卷(3)

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1、华侨大学信息学院《数字逻辑》A试卷姓名班级学号一、填空（每题2分，共30分）注：结果为逻辑表达式的需要给出其最简积之和式1、逻辑函数的常用表示方法有逻辑表达式、、。2、逻辑函数F=A（B+C）·1的对偶函数是。3、逻辑函数F==。4、逻辑函数=。5、逻辑函数=。6、如果用数据选择器来实现一个3变量的函数，应该用路数据选择器。7、一个基本触发器在正常工作时，有不允许输入的信号，它的约束条件是。8、要使JK触发器按工作，可使JK触发器的输入端J=，K=。9、设计一个模6计数器要用个触发器。10、按状态改变是否同时，时序电路分为和电路。11、与阵列固定、或阵

2、列可编程的PLD是；与阵列可编程、或阵列固定的PLD是。12、用PROM实现四输入三输出的组合逻辑电路，则要求PROM的存储单元至少有_____个，存储单元的位数为_______位。13、EPROM的编程单元是__________1４、GAL16V8的___________主要包含控制电路组态的多路开关和触发器。15、观察下图所示的PROM阵列图，输出函数F=__________________8二、分析下图组合电路的逻辑功能。（10分）１）写出电路的逻辑函数表达式２）列出电路真值表３）功能描述及电路评价三、组合电路设计题。设计一个判别电路，以判断84

3、21码所表示的十进制数之值是否小于等于5。（18分）１）给出电路真值表２）给出电路的逻辑表达式３）卡诺图化简该表达式４）画出电路图四、分析下图所示的同步时序电路，要求：（17%）１）列出控制函数和输出函数表达式２）建立次态次态表达式及状态转移表３）建立状态表及状态图４）说明这是一个什么型的电路及所完成的逻辑功能8五、时序电路设计题。用与非门及JK触发器设计一个“01”序列检测器，要求步骤完整。（15分）六、用隐含表法化简下列状态表(10%)8参考答案一、填空1.真值表、卡诺图（列表法）2.A+BC3.04.AB+AB5.6.47.Rd+Sd=18.1,

4、19.310.同步，异步11.PROM,GAL(PAL)12.16,313.FAMOS14.OLMC15.二、1）2)A3A2A1A0B3B2B1B0000000010010001101000101011001111000100110101011110011011110111100000001001100100110011101010100110011011111111010101011100110003)电路的功能是将输入的四位二进制码转换成格雷码，电路没有冗余8三、1)ABCDF00000001001000110100010101100111100

5、010011010101111001101111011111111110000φφφφφφ2）注:加了”或”4)四、1）2)次态表达式如下8状态转移表如下：3）状态图如下状态表如下：84）这是一个摩尔型电路，功能是可逆模4计数器五、1）电路框图如下2)电路状态图和状态表如下：3）状态编码如下：4）编码状态表如下：5）控制及输出函数真值表如下：XYZJK00011011101φ00φ0000φ01φ16)电路图如下8六、化简结果如下：8