09级-数字逻辑与数字系统复习题

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1、1、选择题1．一位十六进制数可以用C位二进制数来表示。A.１B.２C.４D.162．十进制数25用8421BCD码表示为B。A.10101B.00100101C.100101D.101013.以下表达式中符合逻辑运算法则的是D。A.C·C=C2B.1+1=10C.0<1D.A+1=14.当逻辑函数有n个变量时，共有D个变量取值组合？A.nB.2nC.n2D.2n5．A+BC=C。A.A+BB.A+CC.（A+B）（A+C）D.B+C6．在何种输入情况下，“与非”运算的结果是逻辑0。DA．全部输入是0B.任一输入是0C.仅一输入是0D.全部输入是17.以下

2、电路中可以实现“线与”功能的有C。A.与非门B.三态输出门C.集电极开路门D.CMOS与非门8．以下电路中常用于总线应用的有A。A.TSL门B.OC门C.漏极开路门D.CMOS与非门9．若在编码器中有50个编码对象，则要求输出二进制代码位数为B位。A.5B.6C.10D.5010.一个16选一的数据选择器，其地址输入（选择控制输入）端有C个。A.1B.2C.4D.1611．四选一数据选择器的数据输出Y与数据输入Xi和地址码Ai之间的逻辑表达式为Y=A。A.B.C.D.12.一个8选一数据选择器的数据输入端有E个。A.1B.2C.3D.4E.813．在下列

3、逻辑电路中，不是组合逻辑电路的有D。A.译码器B.编码器C.全加器D.寄存器14．八路数据分配器，其地址输入端有C个。A.1B.2C.3D.4E.815．用四选一数据选择器实现函数Y=，应使A。A.D0=D2=0，D1=D3=1B.D0=D2=1，D1=D3=0C.D0=D1=0，D2=D3=1D.D0=D1=1，D2=D3=016.N个触发器可以构成能寄存B位二进制数码的寄存器。A.N-1B.NC.N+1D.2N17．在下列触发器中，有约束条件的是C。A.主从JKF/FB.主从DF/FC.同步RSF/FD.边沿DF/F18．一个触发器可记录一位二进制代

4、码，它有C个稳态。A.0B.1C.2D.3E.419．存储8位二进制信息要D个触发器。A.2B.3C.4D.820．对于D触发器，欲使Qn+1=Qn，应使输入D=C。A.0B.1C.QD.21．对于JK触发器，若J=K，则可完成C触发器的逻辑功能。A.RSB.DC.TD.Tˊ22．欲使D触发器按Qn+1=n工作，应使输入D=D。A.0B.1C.QD.23．下列触发器中，没有约束条件的是BD。A.基本RS触发器B.主从RS触发器C.同步RS触发器D.边沿D触发器24．为实现将JK触发器转换为D触发器，应使A。A.J=D,K=B.K=D,J=C.J=K=DD

5、.J=K=25.边沿式D触发器是一种C稳态电路。A.无B.单C.双D.多26．把一个五进制计数器与一个四进制计数器串联可得到D进制计数器。A.4B.5C.9D.2027．下列逻辑电路中为时序逻辑电路的是C。A.变量译码器B.加法器C.数码寄存器D.数据选择器28.N个触发器可以构成最大计数长度（进制数）为D的计数器。A.NB.2NC.N2D.2N29.N个触发器可以构成能寄存B位二进制数码的寄存器。A.N-1B.NC.N+1D.2N30．同步时序电路和异步时序电路比较，其差异在于后者B。A.没有触发器B.没有统一的时钟脉冲控制C.没有稳定状态D.输出只与

6、内部状态有关31．一位8421BCD码计数器至少需要B个触发器。A.3B.4C.5D.1032.欲设计0，1，2，3，4，5，6，7这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应使用B级触发器。A.2B.3C.4D.833．8位移位寄存器，串行输入时经D个脉冲后，8位数码全部移入寄存器中。A.1B.2C.4D.834．用二进制异步计数器从0做加法，计到十进制数178，则最少需要D个触发器。A.2B.6C.7D.8E.101、判断题（正确打√，错误的打×）1.方波的占空比为0.5。（√）2.8421码1001比0001大。（×）3.数字电路中

7、用“1”和“0”分别表示两种状态,二者无大小之分。（√）4．八进制数（18）8比十进制数（18）10小。（×）5．当传送十进制数5时，在8421奇校验码的校验位上值应为1。（√）6．在时间和幅度上都断续变化的信号是数字信号，语音信号不是数字信号。（√）7．占空比的公式为：q=tw/T，则周期T越大占空比q越小。（√）8．十进制数（9）10比十六进制数（9）16小。（×）9．逻辑变量的取值，１比０大。（×）。10．异或函数与同或函数在逻辑上互为反函数。（√）。11．若两个函数具有相同的真值表，则两个逻辑函数必然相等。（√）。12．若两个函数具有不同的真值表

8、，则两个逻辑函数必然不相等。（√）13．若两个函数具有不同的逻辑函数式，则两个逻