准循环低密度校验码译码器设计和实现

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1、摘要本文采用理论分析和计算机仿真相结合的方法，在已有的理论基础上研究了低密度校验码编译码器的设计与实现问题，着重研究了准循环低密度校验码译码器的FPGA实现，完成了以下几个方面的工作：1．介绍了低密度校验码特别是准循环低密度校验码的相关概念，并归纳出了数字电视地面广播传输系统中用到的准循环低密度校验码的特点。2．介绍了用校验矩阵来实现低密度校验码快速编码的方法，分析了如何用移位寄存器在线性时间内完成准循环低密度校验码编码的问题，在此基础上给出了数字电视广播传输标准中准循环低密度校验码的编码实现方案。3．介绍了低密度校验码译

2、码的置信传播算法，系统地总结并比较了对数似然比量度下置信传播算法的四种改进算法和三种消息迭代模式。4．提出了准循环低密度校验码的两种部分并行译码结构，选择其中译码速度较快的一种在ALTERA公司的StratixlI—EP2S90F1020C5FPGA器件实现了DTMB系统中三种准循环低密度校验码的译码器。关键词：准循环低密度校验码置信传播算法部分并行译码结构FPGA实现AbstractThedesignandimplementationoftheencoderanddecoderforLow-DensityParity-C

3、heckCLDPC)codesonFPGAdeviceisstudiedbytheoreticalanalysisandsimulation．Themainresu]tsandcontentsareasfollows．1．1kdefinitionandstructRreofQuasi-Cyclic(QC)LDPCcodesareintroduced,thecharacteristicsoftheQC-LDPCcodesinDTMBsystemareconcluded．2．Thelineartimeencodingprobl

4、emforLDPCcodesspecifiedbyparit’‘-checkmatrixisstudied．neissueofefficientencodingofQC-LDPCcodesusingsimpleshiftregistersisaddressed．Basedonthis，theimplementationdesignforencoderofQC-LDPCcodesinDTMBsystemisproposed．3．nebelief-propagation(BP)decodingalgorithmforLDPCc

5、odesispresented．FourBP—baseddecodingalgorithmsandthreekindsofinformationp嬲singmodearesummarizedandcomparedsystematically．4．Twopartially-paralleldecoderarchitecturesforQC-LDPCcodesareproposed．BasedonthemoreefficientoneadecoderforthethreekindsofQC·LDPCcodesinDTMBsys

6、temisimplementedontheFPGAdeviceAITERAStratixll．EP2S90F1020C5．Keywords：Quasi-Cyclic(QC)Low-DensnyPari锣一Check(LDPC)codesBelief-propagationdecodingalgorithmPalliaUy·paralleldecodingarchitectureFPGAimplementation西安电子科技大学学位论文独创性(或创新性)声明秉承学校严谨的学风和优良的科学道德，本人声明所呈交的论文是我个人在

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