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1、成绩指导教师曰期张歆奕五邑大学实验报告实验课程名称:电子系统EDA院系名称：信息工程学院专业名称：电子信息工程实验项目：学号显示电路设计班级：学号：报告人：一、实验目的1、学习基于VerilogHDL的设计，拈设计输入、设计处理、仿真和下载验证；2、学习基于状态机的设计二、实验原理用数码管除了可以妞示0、的阿拉伯数字外，还可以敁示一些英语字母。数码管由7段显示输出，利用7个位的组合输出，就可以形成部分英语字母和（T9十个数字的显示。利用数码管的静态显示可以实现一个数码管循环显示学号的功能；利用数码管的动态显示原理则可以实
2、现多个数码管的学号显示（滚屏）功能。三、设计要求用VcrilogHDL设计学号显示电路，显示Cl己的学号：耍求一.•用1个数码管按顺序显示自己的学号，输入时钟可以用1个轻触键KEY实现。要求二：用8个数码管显示学号，并向左或向右滚屏。、程序设计一）基于1位数码管的学号显示电路的设计1.VeriloHDL源码：modulexuehao_display(elk,rst,outO);inputelk,rst;outputreg[6:0]outO;reg[3:0]state;parameters0=4’d0,sl=4,dl,s2
3、=4,d2,s3=4,d3,s4=4,d4,s5=4,d5,s6=4,d6,s7=4’d7;always@(posedgeelkornegedgerst)beginif(!rst)beginout0=7,bOl11111;statc=s0;endelsebegincase(state)state<=sl;endstatc<=s2;endstate〈=s3;endstate<=s4;endstate<=s5;end//display1//display2//display0//display7//display0sO:be
4、ginout0=7’blOOl111si:beginout0=7’bOOlOOlOs2:beginout0=7’bOOOOOOls3:beginout0=7’bOOOlllls4:beginout0=7’bOOOOOOl//display2//display0//display7s5:beginout0=7’bOOlOOlO;state<=s6;ends6:beginout0=7’bOOOOOOl;state<=s7;ends7:beginout0=7’bOOOllll;state<=sO;enddefault:stat
5、e<=0;cndcascendendmodule1.源码说明、仿真及实现结果仿真结采如卜*:Namevaxue160.C••••D^OelkBi1^1rstB1::::::::1昏2田outOB00011111111~Xiooi111Xooi0010X0000001XoooiiiiXooooooiXooiooioXooooooiXoooiiiiXiool）基于8个数码管的花样学号显示1.VeriloHDL源码modulexuehao_display(elk,rst,out,outl，out2,out3,out4,out5
6、,out6,out7,led);inputelk,rst;outputreg[6:0]out,out1,out2,out3,outd,out5,out6,out7;outputregled;reg[3:0]state;parameters0=4’d0,sl=4’dl,s2=4’d2,s3=4’d3,s4=4’d4,s5=4’d5,s6=4’d6,s7=4’d7;parameterling=7,bOOOOOOl,yi=7，bl001111,er=7，b0010010,qi=7,bOOOllll,wu=7,blllll11；
7、always®(posedgeelkornegedgerst)beginif(!rst)beginout=7,blllllll;state=s0;endelsecase(state)sO:beginled=~led;out7=wu;out6=wu;out5=wu;out4=wu;out3=wu;out2=wu;outl=wu;out=yi;state<=sl;endsi:beginled=^led;outl=yi;out=er;state<=s2;ends2:beginlcd=^lcd;out2=yi;outlier;o
8、ut=ling;statc<=s3;ends3:beginled=~led;out3=yi;out2=er;out1=1ing;out=qi;state<=s4;ends4:beginled=~led;out4=yi;out3=er;out2=ling;outl=qi;out=ling;state<=s5;ends5
