数字逻辑电路第4-5章复习题

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1、1-1、试分析下图所示时序逻辑电路，列出状态表，画出状态图和波形图。（15分）1-2、试分析下图所示的电路，画出它的状态图，说明它是几进制计数器？（74160是十进制计数器，异步清零且低电平有效）。（10分）2-1、（15分）时序数字电路如下图所示。写出电路的驱动方程、状态方程和输出方程，画出电路的状态转换图，说明电路的逻辑功能。2-2（10分）、分析下图所示时序逻辑电路，74LS161的功能表如下。问：①分析输入信号、、ET和EP的功能。②画出下图的状态转换图，说明它是几进制计数器（设0000为初始状态）。表四位

2、二进制计数器74LS161功能表CPETEPQ3Q2Q1Q0×0×××0000↑10××D3D2D1D0×110×保持×11×0保持↑1111计数3-1、（12分）、试用74161采用反馈复位法构成十二进制计数器。161的功能表和示意图如下。（要求写出分析过程，画出状态转换图并连线）。同步四位二进制加法计数器74161功能表输入输出EPETCPD0D1D2D3Q0Q1Q2Q0××××××××000010××↑d0d1d2d3d0d1d2d31111↑××××计数110××××××保持11×0×××××保持4-1、（

3、15分）、分析下图所示时序逻辑电路。要求列出状态转换表，画出完整的状态转换图，并说明该电路的逻辑功能。假设各触发器初始状态均为0。4-2（10分）、电路如下图所示，已知CP和A、B的波形，试写出Q1和Q2的状态方程，并画出Q1和Q2的波形。设触发器的初始状态均为0。5-1（12分）、分析下图所示时序逻辑电路，74LS161的功能表如下。问：①分析输入信号、、ET和EP的功能。②画出下图的状态转换图，说明它是几进制计数器（设0000为初始状态）。表四位二进制计数器74LS161功能表CPETEPQ3Q2Q1Q0×0×

4、××0000↑10××D3D2D1D0×110×保持×11×0保持↑1111计数5-2（15分）、试分析下图题所示时序逻辑电路，写出驱动方程、输出方程和状态方程，列出状态表，画出状态图和波形图，并说明电路的逻辑功能。6-1（8分）、由或非门组成的下降沿触发和上升沿触发两种触发方式的主从RS触发器的逻辑符号及CP、S、R的波形如下图所示，分别写出Q1和Q2的状态方程说明CP触发方式，并画出它们的Q端的波形（设初始状态为Q＝0）。6-2（8分）、74161的逻辑功能表如下表，试分析161的清零和置数信号是异步还是同步？

5、分析下图所示的电路，画出它的状态图，说明它是几进制计数器。6-3（14分）试分析下图所示的计数器电路。写出它的时钟方程、输出方程、驱动方程和状态方程，列出状态状态转换图，说明是几进制计数器。7-1（15分）、分析下图为几进制计数器。要求列出状态转换表并画出工作波形，设Q0~Q3的初态为零态。CT74LS290CT74LS290功能表功能8-1（12分）、电路如图题所示，已知CP、RD和D的波形，试说出RD、SD端的作用，写出Q0和Q1的状态方程，并画出Q0和Q1的波形。设触发器的初始状态均为1。8-2、（10分）用

6、74LS290实现N=6计数器R01R02S01S02Q0Q1Q2Q374LS290CP0OCP1O9-1（10分）、一个触发器的特性方程为，试用D触发器实现这种触发器的功能。9-2（10分）、161用反馈置数法构成6进制计数器。（161功能表和示意图如下）。（1）分析输入信号、、ET和EP的功能。（2）画出六进制的状态转换图，并在示意图中连线成六进制计数器。表四位二进制计数器74LS161功能表CPETEPQ3Q2Q1Q0×0×××0000↑10××D3D2D1D0×110×保持×11×0保持↑1111计数10-

7、1（9分）一个触发器的特性方程为，试用JK触发器实现这种触发器的功能。10-2（14分）集成计数器7416l的功能表如下，请连接成下列计数器，并画出状态图：（1）用反馈清零法构成八进制计数器；（2）用反馈置数法构成十二进制计数器。表四位二进制计数器74LS161功能表CPETEPQ3Q2Q1Q0×0×××0000↑10××D3D2D1D0×110×保持×11×0保持↑1111计数CT74LS290CT74LS290功能表11-1分析下图为几进制计数器。要求列出状态转换表并画出工作波形，设Q0~Q3的初态为零态。（1

8、5分）11-2、下图是用16×4位EPROM画出存储矩阵的连线图，试写出下列各输出的逻辑函数。（8分）12-1、试用四位二进制计数器CT74LS161和门电路构成九进制计数器。要求写出设计过程，并列出状态转换表。　（13分）　　　13-1、试画出四个CP脉冲作用下Q1~Q3的波形。(设各触发器初态为零)(9分)13-2、试分别利用十进制计数器CT74LS16