二十进制加法计数器电路的设计

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1、新疆大学课程设计报告所属院系：电气工程学院专业：电气工程课程名称：电子技术B课程设计设计题目：20进制加法计数器电路的设计班级：电气10-4班学生姓名：克依斯尔.卡合曼学生学号：20102101454指导老师:王红琳努尔买买提完成日期：2014.01.13—2014.01.20课程设计题目：20进制加法计数器电路的设计要求完成的内容：自行设计一20进制加法计数器电路，可选择与门、或门、与非门及触发器电路等实现。（1）了解EDA技术的概念、发展及应用。（2）掌握VHDL语言的基础知识，熟悉在数字电路系统设计中VHDL程序设计。（3）学习MAX+PL

2、USⅡ软件的应用方法。（4）应用EDA技术的设计方法完成（采用原理图和文本法两种方法实现），并在MAX+PLUSⅡ软件上仿真。（5）需在实验室搭建电路验证并请认真按格式完成课程设计报告。主要收获体会与存在的问题：收获：这次课程设计我受益匪浅。在摸索该如何设计电路使之实现所需功能的过程中，不尽培养了我的设计思维，也让我体会到了设计电路的艰辛。而且通过这次设计我学会了新的软件，VHDL语言和EDA技术，这让我在知识方面有了更进一步的提升。存在问题：在这次设计中我们遇到的主要问题就是对MAX+plusII软件功能的不理解。导致了用MAX+plusII软件画

3、原理图和求出输出波形是出现了错误，因而画来画去交报告时间推迟了好多。指导教师评语：按设计任务书要求完成规定设计任务；综合运用知识能力和实践动手能力较强，软件设计方案较合理，实验效果较好；设计成果质量较高；设计态度认真，有一定的独立工作能力，并具有较好的团队协作精神。设计报告条理清晰、论述正确、图表较为规范、符合设计报告文本格式要求。该生思路清晰、论点基本正确、对设计方案理解较深入，主要问题回答基本正确。评定成绩为：指导教师签名：年月日20进制加法计数器电路的设计1．设计目的（1）了解EDA技术的概念、发展及应用。（2）掌握VHDL语言的基础知识，熟悉

4、在数字电路系统设计中VHDL程序设计。（3）学习MAX+PLUSⅡ软件的应用方法。（4）应用EDA技术的设计方法完成（采用原理图和文本法两种方法实现），并在MAX+PLUSⅡ软件上仿真。（5）需在实验室搭建电路验证并请认真按格式完成课程设计报告。2．设计内容maxplus2MAX+PLUSII把这些设计转自动换成最终所需的格式。其设计速度非常快。对于一般几千门的电路设计，使用MAX+PLUSII，从设计输入到器件编程完毕，用户拿到设计好的逻辑电路，大约只需几小时。设计处理一般在数分钟内完成。特别是在原理图输入等方面，Maxplus2被公认为是最易使用

5、，人机界面最友善的PLD开发软件，特别适合初学者使用。EDA（ElectronicDesignAutomation）EDA技术就是依靠功能强大的电子计算机，在EDA工具软件平台上，对以硬件描述语言HDL为系统逻辑描述手段完成的设计文件，自动地完成逻辑编译、化简、分割、综合、优化、仿真，直至下载到可编程逻辑器件CPLD/FPGA或专用集成电路ASIC芯片中，实现既定的电子电路设计功能。2.2电路的分析（1）创建电路文本图：（3）20进制计数器的原理图：（4）原理图输出波形图：可见当LD信号为“1”是不管CLK信号是什么都不工作。只要LD为“0”是才能正

6、常工作。文本原理图其功能表如下：             输入    输出MRP3P2P1P0Q3Q2Q1Q0 1 × × ×××××0000 0 0 × ×dcbadcba 0 1  1××××   加计数 0 1 1 ××××   减计数实验接线图：(5)结束语利用MAXPLUS2仿真软件完成了20进制加法计数器原理图及波形仿真，仿真结果与预期相符，实现了20进制的加法。这个软件快捷方便，功能强大。能方便的实现20进制加法计数器的仿真。个人体会经过几天的摸索，我的课程设计终于完成了。在没有做课程设计以前觉得课程设计只是对所学知识的单纯总结，但是通

7、过这次做课程设计发现自己的看法有点太片面。课程设计不仅是对前面所学知识的一种检验，而且也是对自己能力的一种提高。通过这次课程设计使我明白了自己原来知识还比较欠缺。自己要学习的东西还太多，以前老是觉得自己什么都会，什么东西都懂，有点眼高手低。通过这次课程设计，我才明白学习是一个长期积累的过程，在以后的工作、生活中都应该不断的学习，努力提高自己知识和综合素质。在这次课程设计中，我和同学的关系也更近了，同学之间互相帮助，有什么不懂的大家在一起商量，听听不同的看法让我们更好的理解知识，所以在这里非常感谢帮助我的同学及我的搭档。总体来说，这次课程设计我受益匪浅

8、。在摸索该如何设计电路使之实现所需功能的过程中，特别有趣，培养了我的设计思维，在让我体会到了设计电路的艰辛的