串行扫描显示电路设计

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1、串行扫描显示电路设计一．实验目的1．通过用VHDL语言设计串形扫描显示电路进一步掌握使用VHDL方法。2．熟悉使用CPLD/FPGA实验箱的数码管进行显示。二．实验仪器1．PC机一台2．KHF-1/KHF-2/KHF-3/KHF-4/KHF-5CPLD/FPGA实验开发系统一套。三、实验要求1．预习串行扫描显示的原理2．复习教材相关内容。3．用硬件描述语言进行电路设计。四、实验内容及实验步骤1．串形扫描显示电路设计原理输入时钟inlck为50Mhz，经分频为1hz，再进行0—F范围计数，计数的结果分别在seg3~seg10这8个串行

2、数码管显示；8个数码管受74138译码器的控制；74138Fpga模块Inclk~Pin183A~p180B~186C~187Abcdefga,b,c,d,e,f,g，p段-------189,190,191,192,193,195,196，1972.编译。3.分配管脚。4.编译。5.启动下载软件进行下载。:五．实验代码libraryieee;useieee.std_logic_1164.all;useieee.std_logic_unsigned.all;entitytcxisport(inclk:instd_logic;outb

3、:outstd_logic_vector(7downto0);outa:outstd_logic_vector(2downto0));endtcx;architecturearch_tcxoftcxissignalma:std_logic_vector(2downto0);signalmb:std_logic_vector(3downto0);signalfp:std_logic_vector(24downto0);signalf:std_logic;beginprocess(inclk)beginif(inclk'eventand

4、inclk='1')theniffp=24999999thenfp<="0000000000000000000000000";f<=notf;elsefp<=fp+1;endif;endif;endprocess;process(f)beginif(f'eventandf='1')thenma<=ma+1;mb<=mb+1;endif;endprocess;outa<=ma;withmbselectoutb<="10110000"when"0001",--1"11101101"when"0010",--2"11111001"when

5、"0011",--3"10110011"when"0100",--4"11011011"when"0101",--5"11011111"when"0110",--6"11110000"when"0111",--7"11111111"when"1000",--8"11111011"when"1001",--9"11110111"when"1010",--A"10011111"when"1011",--B"11001110"when"1100",--C"10111101"when"1101",--D"11001111"when"1110

6、",--E"11000111"when"1111",--F"11111110"whenothers;--0endarch_tcx;六．实验心得通过了解到用VHDL语言设计串形扫描显示电路进一步掌握使用VHDL方法。熟悉使用CPLD/FPGA实验箱的数码管进行显示。