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时间:2020-09-08
《2014通信电子电路与EDA技术A卷.doc》由会员上传分享,免费在线阅读,更多相关内容在教育资源-天天文库。
1、桂林电子科技大学硕士研究生入学考试复试试卷考试科目代码:208考试科目名称:通信电子电路与EDA技术A请注意:答案必须写在答题纸上(写在试卷上无效)。一、单项选择题(每题2分,共14分)1.由两个相同的单调谐放大器组成的两级放大电路若单级的通频带,则两级放大器的通频带是()。A、10B、20C、6.4D、52.若高频谐振功率放大器的输入电压,高频功放工作于过压状态,则其集电极电流是()脉冲,集电极输出电压是()信号。A、尖顶余弦,尖顶余弦B、尖顶余弦,余弦C、顶部下凹的尖顶余弦,尖顶余弦D、顶部下凹的尖顶余弦,余弦3.若下图所示的高频交流等效电路能振荡(不考虑晶体管内部电容的影响
2、),则它应属于()振荡器。A、电容反馈三点式B、电感反馈三点式C、RCD、互感耦合4.模拟相乘器不可以完成的功能有()。A、调幅B、检波C、混频D、调频5.下图所示的框图能实现何种功能?()A、混频B、产生抑制载波双边带调幅波C、产生AM信号D、调幅波的解调6.乘积型鉴相器的线性鉴相范围为()。A、±B、±C、±D、±7.锁相频率合成器是利用锁相环的()。A、滤波特性B、跟踪特性C、环路锁定后没有剩余频差D、易于集成化二、计算题(每题12分,共36分)1.某工作于临界状态的高频功率放大器电源电压,集电极输出电压幅度,电流通角,晶体管输出特性饱和线斜率。(;)(1)求集电极电流脉冲
3、幅度;(2)求集电极电流中直流电流;(3)求集电极电流中基波电流幅度;(4)求电源提供的直流功率;(5)求集电极输出交流功率;(6)求集电极功率效率;共4页第1页请注意:答案必须写在答题纸上(写在试卷上无效)。2.某振荡电路如图所示。、、是旁路电路或隔直电容,是高频扼流圈。(1)画出高频交流等效电路(不考虑的损耗电阻),并说明是什么类型的振荡电路;(2)求回路总电容;(3)求振荡角频率;(4)此电路的反馈系数F。3.已知调制信号,调角波的瞬时频率为,调角波的幅度是10V。(1)该调角波是调频波还是调相波?(2)写出调制信号的频率F和载波信号的频率。(3)计算此调角波的数学表达式。
4、(4)计算调角波的带宽。(4)若调制信号幅度加倍,其余参数不变,则其带宽变成多少?三、选择题(每题1分,共10分)1.在verilog中,下列语句哪个不是分支语句?()(A)if-else(B)case(C)casez(D)repeat2.下列不属于常用贴片电阻封装的是()A、0402B、0805C、0903D、12063.下列标识符中,__________是不合法的标识符。A.9moonB.State0C.Not_Ack_0D.signall4.下列语句中,不属于并行语句的是:_______A.过程语句B.assign语句C.元件例化语句D.case语句5.常用的“DIP8”封
5、装,第一脚与第二脚之间的间距为()A、2mmB、1.5mmC、100milD、150mil共4页第2页请注意:答案必须写在答题纸上(写在试卷上无效)。6.如右图中“桂林电子科技大学”字样属于电路板()层A、toplayerB、topoverlayC、topsolderD、toplayer7.右图中正央芯片的封装为()A、PLCC100B、TQFP100C、DIP100D、SOL1008.右图中正中央芯片的型号为“EP2C5T144C8N”其中“C8”的含义为A、芯片中有8个LAB单元B、芯片中有8个IO配置模块C、芯片的门延迟为8nSD、芯片数据总线宽度为8位9.在进行PCB设计
6、时,下面那个层表示板中的焊盘:A、keepoutlayerB、multilayerC、topoverlayD、bottomlayer10.在verilog语言中,a=4b'1011,那么&a=()A、4b'1011B、4b'1111C、1b'1D、1b'0四、填空题(每空1分,共10分)1.目前国际上较大的FPGA器件制造公司有和公司。2.状态机按信号输出方式分,有型和型两种。3.阻塞赋值语句的操作符是,非阻塞赋值语句的操作符是。4.函数返回个值,任务返回个值。(填数字)5.VerilogHDL中对于边沿的描述,用关键词描述上升沿,以关键词描述下降沿。五、EDA名词解释(10分)
7、写出下列缩写的中文含义:ASIC:RTL:FPGA:SOPC:CPLD:LPM:EDA:IEEE:IP:ISP: 六、简答题(10分)画出下面程序综合出来的电路图。always@(posedgeclk)beginq0<=~q2;q1<=q0;q2<=q1;共4页第3页请注意:答案必须写在答题纸上(写在试卷上无效)。五、改错题(10)述是一个实现四位数的BCD码加法的程序,请把正确的程序写在试卷上modulebcdadd(clk,a,b,c,d,a1,b1,c1,d1
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