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1、摘要在传统的硬件电路设计屮，设计者总是根据系统的具体要求，选择市场上能够买到的逻辑元件、器件，来构成所要求的逻辑电路，从而完成系统的硕件设计。这种自下至上选择通用元、器件来构成系统硕件电路的方法是目前广大电子工程师所熟悉和掌握的一种传统的设计方法。本课题结合工程应用，设计一种完全基于FPGA的定时器电路，实现定时器的功能。文屮主耍把定时器分成控制器模块、周期模块、分频电路等模块，再把各个模块进一步进行细分，运用VHDL编程语言，对各个模块进行语言编程设计电路,并且进行结果仿真校验。最后进行电路连接，以达到预期的定时器功能，具冇时分秒计数功能，通过
2、该课题，使我对可编程硬件电路的设计和制作得到全面的锻炼和实践，同时也深入了解了数字电路的设计方法，捉高对VHDL语言的变成运用，增强了我的工程开发和设计能力。关键词：FPGA,定时器，控制器模块，周期模块AbstractIntraditionalhardwarecircuitdesign,designersalwaysaccordingtothesystem'sspecificrequirements,choosethemarketcanbuylogiccomponents,components,toformrequiredlogiccircui
3、t,thuscompletingsystemhardwaredesign.Thisfromthefirstchoicegeneralyuan,devicestoconstitutethesystemhardwarecircuitmethodiscurrentlygeneralelectronicengineersarefamiliarwithandacquiredatraditionaldesignmethod・Thistopiccombiningengineeringapplication,designsakindoftimercircuito
4、fcompleteaccordingtoFPGA,realizingthefunctionoftimer.Theresearchdividesthetimeintocontrolmodule,cyclemodule,andfrequencycircuitmodule,controllingkeypartsandsoon,thentakingeachblockmoreprecise,usingVHDLprogrammablelanguage,toeachtheblockcarryonlanguageplaitdistancedesigncircui
5、t,andcarryonresultinordertocheck.Lasttakingcircuitwithconnecting,inordertoattaintoexpectantfunction,havingcountingfunctionofhourminutesecond,Accordingtothetopic,itisbelievedthatittakesmeimportantexperiencethroughtododesignandcreationprogrammablehardwarecircuit,alsohavingain・d
6、epthunderstandingtonumeraldesignmethodofcircuit,improvingusageofVHDLlanguage,strengthenengineeringofdevelopmentanddesignabilityofmy.Keywords:FPGA，timer,controlmodule,cyclemodule目录要错误！未定义书签。Abstract错误！未定义书签。目录错误！未定义书签。第一章概念简要1第二章世界集成电路技术的发展规律第三章设计流程与功能错误！未定义书签。J.3.1现代数字系统的设计流程
7、5§3.2功能分析6U!章定时计数器的分析和设计7§4」总线控制部分设计7§4.2计数器部分设计$§4.3设计结果验证15第五章程序设计16第六章编译及仿真19第七章主控制器算法状态机图描述20J_7.1定时器算法状态机图描述22§7.2控制器算法状态机图描述22第八章控制电路的VHDL语言描述23§主分频器timectr_clkdiv模块-23§8.2定时器控制timer.ctr模块25§8.3定时器timer_count模块29§&4周期控制timeronoff_ctr模块33§8.5运转定时控制电路timer_sum模块-37J_&6分频电
8、路模块-39§&6.110分频电路模块40§&6.260分频电路模块41§&7触发器diff3模块42第九章整体原理图及所用器件型号和参
