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时间:2018-09-23
《数字电子技术基础复习试题4套(中南大学).doc》由会员上传分享,免费在线阅读,更多相关内容在教育资源-天天文库。
1、(第一套)一、填空题:(每空1分,共15分)1.逻辑函数的两种标准形式分别为()、()。2.将2004个“1”异或起来得到的结果是()。3.半导体存储器的结构主要包含三个部分,分别是()、()、()。4.8位D/A转换器当输入数字量10000000为5v。若只有最低位为高电平,则输出电压为()v;当输入为10001000,则输出电压为()v。5.就逐次逼近型和双积分型两种A/D转换器而言,()的抗干扰能力强,()的转换速度快。6.由555定时器构成的三种电路中,()和()是脉冲的整形电路。7.与PAL相比,GAL器件有可编程的输出结构,它是通过对()进行编程设
2、定其()的工作模式来实现的,而且由于采用了()的工艺结构,可以重复编程,使它的通用性很好,使用更为方便灵活。二、根据要求作题:(共15分)1.1. 将逻辑函数P=AB+AC写成与或非型表达式,并用集电极开路门来实现。2.2.图1、2中电路均由CMOS门电路构成,写出P、Q的表达式,并画出对应A、B、C的P、Q波形。三、分析图3所示电路,写出F1、F2的逻辑表达式,说明电路的逻辑功能。图中所用器件是8选1数据选择器74LS151。四、设计一位十进制数的四舍五入电路(采用8421BCD码)。要求只设定一个输出,并画出用最简与非门实现的逻辑电路图。(15分)五、已知
3、电路及CP、A的波形如图5(a)(b)所示,设触发器的初态均为“0”,试画出输出端B和C的波形。12(8分)BC 六、用T触发器和异或门构成的某种电路如图6(a)所示,在示波器上观察到波形如图6(b)所示。试问该电路是如何连接的?请在原图上画出正确的连接图,并标明T的取值。七、电路如图7所示,其中RA=RB=10kΩ,C=0.1μf,试问:1.在Uk为高电平期间,由555定时器构成的是什么电路,其输出U0的频率f0=?2.分析由JK触发器FF1、FF2、FF3构成的计数器电路,要求:写出驱动方程和状态方程,列出状态转换表,画出完整的状态转换图;3.设Q3、Q2
4、、Q1的初态为000,Uk所加正脉冲的宽度为Tw=6/f0,脉冲过后Q3、Q2、Q1将保持在哪个状态?(共15分)12八、图8所示是16*4位ROM和同步十六进制加法计数器74LS161组成的脉分频电路。ROM中的数据见表8所示。试画出在CP信号连续作用下的D3、D2、D1、D0输出的电压波形,并说明它们和CP信号频率之比。(16分)表8地址输入数据输出A3A2A1A0D3D2D1D000000001001000110100010101100111100010011010101111001101111011111111000000110100010110101
5、001100011111100000100100001010001110000 12CP波形如图所示:(第一套)参考答案一、一、填空(每空1分,共15分)1.2.03.地址译码器、存储矩阵、输出缓冲器4.0.039、5.315.双积分型、逐次逼近型6.施密特触发器、单稳态触发器7.结构控制字、输出逻辑宏单元、E2CMO二、根据要求作题:(共15分)1.,OC门线与实现图略2.三、(1)列真值表:(2)逻辑功能:全减器四、设用A3A2A1A0表示该数,输出F。列出真值表如下:12逻辑表达式为:逻辑图如下:五、六、T=1,连线,图略。七、1.多谐振荡器f0=476
6、Hz;2.写出驱动方程3分,状态方程3分,列出状态转换000->100->110->111->011->001->回到100;123.Q3Q2Q1=100(3分) 八、D3、D2、D1、D0频率比分别是1/15、3/15、5/15、7/15;(第二套)一、填空题:(每空1分,共16分)1.逻辑函数有四种表示方法,它们分别是()、()、()和()。2.将2004个“1”异或起来得到的结果是()。3目前我们所学的双极型集成电路和单极型集成电路的典型电路分别是()电路和()电路。4.施密特触发器有()个稳定状态.,多谐振荡器有()个稳定状态。5.已知Intel211
7、4是1K*4位的RAM集成电路芯片,它有地址线()条,数据线()条。6.已知被转换的信号的上限截止频率为10kHz,则A/D转换器的采样频率应高于()kHz;完成一次转换所用的时间应小于()。7.GAL器件的全称是(),与PAL相比,它的输出电路是通过编程设定其()的工作模式来实现的,而且由于采用了()的工艺结构,可以重复编程,使用更为方便灵活。二、根据要求作题:(共16分)1.1. 试画出用反相器和集电极开路与非门实现逻辑函数。2、图1、2中电路由TTL门电路构成,图3由CMOS门电路构成,试分别写出F1、F2、F3的表达式。12 三、已知电路及输入波形如图
8、4(a)(b)所示,其中FF1是D锁存
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