基于vhdl的数字钟设计

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1、安徽工业经济职业技术学院毕业论文（设计）题目：基于VHDL的数字钟设计系别：电子信息技术系专业：电子信息工程技术学号：学生姓名：指导教师：职称：二〇一四年五月月十三日17【摘要】20世纪90年代，国际上电子和计算机技术较为先进的国家，一直在积极探索新的电子电路设计方法，并在设计方法、工具等方面进行了彻底的变革，取得了巨大成功。在电子技术设计领域，可编程逻辑器件（如CPLD、FPGA）的应用，已得到广泛的普及，这些器件为数字系统的设计带来了极大的灵活性。EDA技术在电子系统设计领域越来越普及，本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟，【

2、关键词】数字钟EDAVHDL语言17目录摘要：.........................................................................................................................1关键词：………………...........................................................................................1绪论………………………………………………………………………………

3、....31.设计目的..............................................................................................................42.设计内容...............................................................................................................43.设计原理.................................

4、..............................................................................43.1数字钟的基本工作原理…………………………………………….….………43.2数字钟设计的电路原理图……………………………..………………………6.4.单元模块的设计………………………………………………………………….64.1秒计数器的模块………………………………………………………….……..64.2分计数器的模块…………………………..…………………………….............84.3时

5、计数器的模块……………………………………..……………………...…104.4整点报时器模块…………………………………………………………….....124.5调时调分模块………………………..………………………………….……..134.6LED显示译码器模块…………………………………………..………..…..155.仿真结果………………………………………………………………………..17.结语..................................................................................

6、.......................................17参考文献...............................................................................................................18绪论ＥＤＡ是电子设计自动化（ＥlcctronicDesignAutomation）的缩写，是90年代初从CAD（计算机辅助设备），CAM(计算机辅助制造)，CAT（计算机辅助测试）和CAE（计算机辅助工程）的概念发展而来的。EDA技术是以计算

7、机为工具，根据硬件描述语言HDL完成的设计文件，自动的完成逻辑编译，化简，分割，综合及优化，布局布线，仿真以及对特定目标芯片的适配编译和编程下载等工作，这种将设计实体内外部分的概念是VHDL系统设计的基本点。应用VHDL进行工程设计的优点是多方面的。其优点是：与其它硬件描述语言相比，VHDL具有更强的行为描述能力，从而解决了他成为系统设计领域最佳的硬件描述语言，强大的行为描述能力是避开具体的器件结构，从逻辑行为上描述和设计大规模电子系统的重要保证；VHDL丰富的仿真语句和库函数，使得在任何大系统的设计早期就能查验设计系统的功能和可行性，及时可对设计进行

8、。它的计时周期为24小时，显示满刻度为24时59分59秒，另外还具有校时功能和闹钟功能。总的程