3组合逻辑电路习题解答

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1、3组合逻辑电路习题解答61自我检测题1．组合逻辑电路任何时刻的输出信号，与该时刻的输入信号有关，与以前的输入信号无关。2．在组合逻辑电路中，当输入信号改变状态时，输出端可能出现瞬间干扰窄脉冲的现象称为竞争冒险。3．8线—3线优先编码器74LS148的优先编码顺序是、、、…、，输出为。输入输出均为低电平有效。当输入…为11010101时，输出为010。4．3线—8线译码器74HC138处于译码状态时，当输入A2A1A0=001时，输出=11111101。5．实现将公共数据上的数字信号按要求分配到不同电路中去的电路叫数据分配器。6．根据需要选择一路信号送到公共数据线上的电路叫数据选择器。7．一位

2、数值比较器，输入信号为两个要比较的一位二进制数，用A、B表示，输出信号为比较结果：Y(A＞B)、Y(A＝B)和Y(A＜B)，则Y(A＞B)的逻辑表达式为。8．能完成两个一位二进制数相加，并考虑到低位进位的器件称为全加器。9．多位加法器采用超前进位的目的是简化电路结构×。（√，×）10．组合逻辑电路中的冒险是由于引起的。A．电路未达到最简B．电路有多个输出C．电路中的时延D．逻辑门类型不同11．用取样法消除两级与非门电路中可能出现的冒险，以下说法哪一种是正确并优先考虑的？A．在输出级加正取样脉冲B．在输入级加正取样脉冲C．在输出级加负取样脉冲D．在输入级加负取样脉冲12．当二输入与非门输入为变

3、化时，输出可能有竞争冒险。A．01→10B．00→10C．10→11D．11→0113．译码器74HC138的使能端取值为时，处于允许译码状态。A．011B．100C．101D．01014．数据分配器和有着相同的基本电路结构形式。A．加法器B．编码器C．数据选择器D．译码器15．在二进制译码器中，若输入有4位代码，则输出有个信号。A．2B．4C．8D．1616．比较两位二进制数A=A1A0和B=B1B0，当A＞B时输出F=1，则F表达式是。A．B．3组合逻辑电路习题解答61C．D．17．集成4位数值比较器74LS85级联输入IA＜B、IA=B、IA＞B分别接001，当输入二个相等的4位数据时

4、，输出FA＜B、FA=B、FA＞B分别为。A．010B．001C．100D．01118．实现两个四位二进制数相乘的组合电路，应有个输出函数。A．8B．9C．10D．1119．设计一个四位二进制码的奇偶位发生器（假定采用偶检验码），需要个异或门。A．2B．3C．4D．520．在图T3.20中，能实现函数的电路为。（a）（b）（c）图T3.20A．电路（a）B．电路（b）C．电路（c）D．都不是习题1．分析图P3.1所示组合逻辑电路的功能，要求写出与-或逻辑表达式，列出其真值表，并说明电路的逻辑功能。图P3.13组合逻辑电路习题解答61解：CO=AB+BC+AC真值表ABCSCOABCSCO00

5、00010010001101010101010110010110111111电路功能：一位全加器，A、B为两个加数，C为来自低位的进位，S是相加的和，CO是进位。2．已知逻辑电路如图P3.2所示，试分析其逻辑功能。图P3.2解：（1）逻辑表达式，，，3组合逻辑电路习题解答61（2）真值表ABCFABCF00001001001110110101110101111110（3）功能从真值表看出，ABC=000或ABC=111时，F=0，而A、B、C取值不完全相同时，F=1。故这种电路称为“不一致”电路。3．试用与非门设计一组合逻辑电路，其输入为3位二进制数，当输入中有奇数个1时输出为1，否则输出为

6、0。解：（1）真值表ABCFABCF00001001001110100101110001101111（2）（无法用卡诺图化简）（3）逻辑图4．4位无符号二进制数A（A3A2A1A0），请设计一个组合逻辑电路实现：当0≤A＜8或12≤A＜15时，F输出1，否则，F输出0。解：（1）真值表：A3A2A1A0FA3A2A1A0F00001100003组合逻辑电路习题解答610000000000111101100111010101111111111111110001111011001110101010001110（2）表达式（3）电路图（4）如果要求用与非门实现，则：逻辑图：5．约翰和简妮夫妇有两个

7、孩子乔和苏，全家外出吃饭一般要么去汉堡店，要么去炸鸡店。每次出去吃饭前，全家要表决以决定去哪家餐厅。表决的规则是如果约翰和简妮都同意，或多数同意吃炸鸡，则他们去炸鸡店，否则就去汉堡店。试设计一组合逻辑电路实现上述表决电路。解：（1）逻辑定义：A、B、C、D分别代表约翰、简妮、乔和苏。F=1表示去炸鸡店，F=0表示去汉堡店。（2）真值表ABCDFABCDF3组合逻辑电路习题解答61000000000000111