用VHDL语言设计闹钟系统.doc

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1、用VHDL语言设计闹钟系统(本实验用MAXPLUS2软件和GW48实验箱)课程设计题目：闹钟系统设计及实现目的与任务：1、巩固专业基础知识及EDA的相关知识；2、锻炼综合应用所学知识进行小型系统开发设计的能力；3、培养学生将理论应用于实践的能力；4、设计一个简单的闹钟系统。内容和要求：要求设计一个带闹钟功能的24小时计时器，计时器的外观如图1所示。图1系统外观它包括以下几个组成部分：①显示屏：4个七段数码管显示当前时间(时：分)或设置的闹钟时间；一个发光二极管以1HZ的频率跳动，用于显示秒；②按键key1，用于设置调时还是调分；③按键key2，用于输入新的时间或新的闹钟时间，每按下一

2、次，时或分加1；④TIME(时间)键，用于确定新的时间设置；⑤ALARM(闹钟)键，用于确定新的闹钟时间设置，或显示已设置的闹钟时间；⑥扬声器，在当前时钟时间与闹钟时间相同时，发出蜂鸣声。--key1输入作为计数器的触发信号用来选择数码管LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYkey1_trans_hjcISPORT(CLR_HJC:INSTD_LOGIC;KEY1_HJC:INSTD_LOGIC;Q_HJC:BUFFERSTD_LOGIC_VECTOR(2DOWNTO0)

3、);ENDENTITYkey1_trans_hjcIS;ARCHITECTUREHJCOFkey1_trans_hjcISBEGINPROCESS(CLR_HJC,KEY1_HJC)ISBEGINIF(CLR_HJC='1')THENQ_HJC<="000";ELSIF(KEY1_HJC='1'ANDKEY1_HJC'EVENT)THENIF(Q_HJC="100")THENQ_HJC<="001";ELSEQ_HJC<=Q_HJC+"001";ENDIF;ENDIF;ENDPROCESS;ENDARCHITECTUREHJC;--key2用来设定由key1选中的数码管的值LIBRA

4、RYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYKEY2_TRANS_HJCISPORT(CLR_HJC:INSTD_LOGIC;KEY2_HJC:INSTD_LOGIC;Q2_HJC:BUFFERSTD_LOGIC_VECTOR(3DOWNTO0));ENDENTITYKEY2_TRANS_HJC;ARCHITECTUREARTOFKEY2_TRANS_HJCISBEGINPROCESS(CLR_HJC,KEY2_HJC)ISBEGINIF(CLR_HJC='1')THENQ2_HJC<=

5、"0000";ELSIF(KEY2_HJC='1'ANDKEY2_HJC'EVENT)THENIF(Q2_HJC="1001")THENQ2_HJC<="0000";ELSEQ2_HJC<=Q2_HJC+"0001";ENDIF;ENDIF;ENDPROCESS;ENDARCHITECTUREART;--keybuffer_hjc实现选择数码管并赋值，LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYKEYBUFFER_HJCISPORT(KEY1_CTRL_HJC:INSTD_LO

6、GIC_VECTOR(2DOWNTO0);KEY2_HJC:INSTD_LOGIC_VECTOR(3DOWNTO0);CLK_HJC:INSTD_LOGIC;CLR_HJC:INSTD_LOGIC;NEW_TIME_0_HJC:OUTSTD_LOGIC_VECTOR(3DOWNTO0);NEW_TIME_1_HJC:OUTSTD_LOGIC_VECTOR(3DOWNTO0);NEW_TIME_2_HJC:OUTSTD_LOGIC_VECTOR(3DOWNTO0);NEW_TIME_3_HJC:OUTSTD_LOGIC_VECTOR(3DOWNTO0));ENDENTITYKEYBUF

7、FER_HJC;ARCHITECTUREHJCOFKEYBUFFER_HJCISSIGNALN_T_0:STD_LOGIC_VECTOR(3DOWNTO0);SIGNALN_T_1:STD_LOGIC_VECTOR(3DOWNTO0);SIGNALN_T_2:STD_LOGIC_VECTOR(3DOWNTO0);SIGNALN_T_3:STD_LOGIC_VECTOR(3DOWNTO0);BEGINPROCESS(CLR_HJC,CLK_HJC)ISBEG