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1、.数字秒表设计实验报告学院(系):专业: 学号:学生姓名:指导教师:Word文档.目录摘要41引言61.1FPGA的开发61.2VHDL语言的使用71.3ISE简介81.4modelsim仿真软件的使用82数字秒表的设计92.1时间的概念92.2实验任务及要求92.3系统需求和解决方案102.3.1分频器设计122.3.2按键消抖电路设计122.3.3控制器设计132.3.4计数器设计132.3.5锁存器设计142.3.6扫描显示和控制电路设计142.3.7模块综合153数字秒表的仿真结果153.1各仿真结果163.2分频器仿真163.3计数器仿真164实验结论16Word
2、文档.参考文献17附录17Word文档.摘要本次实验设计使用的软件ISE主要功能包括设计输入、综合、仿真、实现和下载,涵盖了可编程逻辑器件开发的全过程,从功能上讲,完成CPLD/FPGA的设计流程无需借助任何第三方EDA软件。而本次设计目的在于设计一个可以自动计数、清零、锁存、暂停的、显示围为59分59秒,精确度为百分之一秒的数字秒表并熟练利用modelsim仿真软件进行仿真并从中不断检验错误,修改程序达到学习提高的效果。为达到实验目的,本设计分为:分频器,锁存器,计数器,控制器及消抖电路。关键词:ISE;modelsim仿真;数字秒表设计;FPGA可编程逻辑器件;检验;学
3、习Word文档.AbstractTheISEsoftwareusedinexperimentaldesignthemainfunctionincludingdesign,implementation,integration,simulationanddownload,coversthewholeprocessofthedevelopmentofprogrammablelogicdevices,tellfromthefunction,completedthedesignofCPLD/FPGAwithoutusinganythird-partyEDAsoftware.Andth
4、epurposeofthedesignistodesignanautomaticcounting,reset,latches,suspended,displayareafor59minutesand59seconds,accuracyofonepercentseconddigitalstopwatchandskilleduseofthemodelsimsimulationsoftwaresimulationandcontinuousinspectionerror,modifytheprogramtoimprovelearningeffect.Forthepurposeoft
5、heexperiment,thedesignisdividedinto:frequencydivider,latch,counter,controllerandshakecircuit.Keywords:ISE;modelsim;digitalstopwatch;TheFPGAprogrammablelogicdevices;check;learnWord文档.1引言在传统的硬件电路设计中,主要的设计文件是电路原理图,而采用硬件描述语言(VHDL)设计系统硬件电路时主要使用VHDL编写源程序。所谓硬件描述语言,就是该语言可以描述硬件电路的功能、信号连接关系及定时关系。EDA
6、代表了当今电子设计技术发展的方向,它的基本特征是:设计人员按照“自顶向下”的设计方法,对整个系统进行方案设计和功能划分系统的关键电路,用一片或几片专用集成ASI实现,然后采用硬件描述语言(HDL)完成系统设计,最后通过综合器和适配器生成最终的目标,这样的设计方法被称为高层次的电子设计。高层次的设计给我们提供了一种“自顶向下”(Top2Down)的全新设计方法,这种方法首先从系统入手,在顶层进行功能方框图的划分和结构设计.在方框图一级进行仿真、纠错并用硬件描述语言对高层的系统进行描述,在系统一级进行验证,然后用综合优化工具生成具体的门电路网表。1.1FPGA的开发使用FPGA
7、(Field-ProgrammableGateArray),即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点。FPGA的开发相对于传统PC、单片机的开发有很大不同。FPGA以并行运算为主,以硬件描述语言来实现;相比于PC或单片机的顺序操作有很大区别,也造成了FPGA开发入门较难。FPGA开发需要从顶层设计、模块分层、逻辑实现、软硬件调试等多方面着手。