基本门电路实验报告处理.doc

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1、实验三：基本门电路及触发器实验室：实验台号：日期：2016.10.7专业班级：姓名：学号：一、实验目的1.了解TTL门电路的原理，性能好使用方法，验证基本门电路逻辑功能。2.掌握门电路的设计方法。3.验证J-K触发器的逻辑功能。4.掌握触发器转换的设计方法。二、实验内容（一）验证以下门电路的逻辑关系1.用与非门（00）实现与门逻辑关系：F=AB2.异或门（86）：(二):门电路的设计(二选一)1.用74LS00和74LS86设计半加器.2.用TTL与非门设计一个三人表决电路。ABC三个裁判，当表决某个提案时，多数人同意提案为通过。（1为同意，0为

2、不同意）要求：用74LS00和74LS10芯片。（三）验证JK触发器的逻辑关系1．J-K触发器置位端、复位端及功能测试。图3-1JK触发器(74LS112)和D触发器(74LS74)2、设计J-K触发器转化成D触发器的电路利用与非门和J-K触发器设计并测试逻辑功能。三、实验原理图图3-2与门电路图3-3异或门电路图3-4半加器四、实验结果及数据处理1．直接在实验原理图上标记芯片的引脚。2．写出实验结果。（1）与门、异或门实验结果表（用数字万用表测量高低电平1、0的电压值。）输入与门异或门ABFUo（V）F0000.13200100.1321100

3、0.13211113.5190（2）半加器实验结果AnBn0000011010101101(3)表决电路结果ABCF000001010011100101110111（4）表决电路图（可以拍照图）：（5）J-K触发器的功能测试输入端输出原态输出次态JKQnQn+101***110***0110000110100111001111101110011110110111011111110（6）设计J-K触发器转化成D触发器的电路（可以拍照图），验证电路的正确性。五、思考题1．实验用的与非门和或门中不用的输入端如何处理?答:与非门：（1）可直接接Vcc；（

4、2）可以通过一个用用的电阻接Vcc；（3）将不用的输入端与使用端并联.。或非门：（1）接地；（2）接到不使用的与门输入端2．如果与非门的一个输入端接时钟，其余输入端应是什么状态时才允许脉冲通过?答:其余输入端应处于高电平状态，置1。3．J-K触发器Qn=0时，如果时钟脉冲CP到来后，触发器处于“1”态，J-K两端应预先分别是什么状态？答:J处于1态，K处于0态。或JK均处于1态。4．J-K触发器与D触发器的触发边沿有何不同?答:J-K触发器为下降沿触发，D触发器为上升沿触发。