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1、10.3969/i.issn.1003-353x.2011.11.008FPGA芯片内数字时钟管理器的设计与实现李文昌1李平1,2杨志明2李威1王鲁豫11.电子科技大学电子薄膜与集成器件国家重点实验室，成都610054;2.成都华微电子科技有限公司，成都610041摘要：在FPGA芯片内，数字时钟管理器(DCM)不可或缺，DCM主要完成去时钟偏移、频率综合和相位调整的功能，其分别由延迟锁相环(DLL)、数字频率合成器(DFS)以及数字相移器(DPS)三个模块来实现。对这三个模块的原理及设计进行了详细地阐述，并给出了仿真结果，该DCM电路通过了
2、0.13μm工艺流片。测试结果表明，在低频模式下，该DCM能工作在24～230MHz之间；在高频模式下，该DCM能工作在48～450MHz之间，其输入及输出抖动容忍度在低频模式下能达到300ps，在高频模式下能达到150ps。FPGA芯片；数字时钟管理器；延迟锁相环；数字频率合成器；数字相移器TN79A1003-353X(2011)11-0848-05DesignandImplementationoftheDigitalClockManagerinFPGALiWenchangLiPingYangZhimingLiWeiWangLuyu8492
3、011年11月l司口@@[1]VirtexⅡplatforrnFPGAuserguide[K].XILINX,INC,2007:48-56.@@[2]HANSR.Asingle-pathpulsewidthcontrolloopwithabuiltindelaylockedloop[J].IEEEJournalofSolidStateCircuits.2005,40(5):1130-1145.@@[3]向志华.FPGA中延迟锁相环的设计[D].四川：电子科技大学，2008:41-44.@@[4]李兆静.FPGA内全数字锁相环的设计[D].四川
4、：电子科技大学，2009:29-33.@@[5]KWANSUHKO,SANJ.Trimunithavinglessjitter[K].Xilinx,INC,2007.@@[6]KWANSUHKO,CAMPBELL.Delaylinetrimunithavingconsistentperformanceundervaryingprocessandtemperaturecondition[K].Xilinx,INC,2003.@@[7]ANDREWKP.Phasematchedclockdivide[K].Xilinx,INC,2006.@@[8
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6、；李平(1957-)，男，教授，博士生导师，主要研究方向为可编程逻辑器件VLSI芯片设计及IP核开发、SOC验证、音视频解码芯片设计；杨志明(1977-)，男，硕士，主要研究方向为可编程逻辑器件VLSI芯片设计及验证。Spansion公司推出业界最快串行闪存产品FPGA芯片内数字时钟管理器的设计与实现作者：李文昌，李平，杨志明，李威，王鲁豫，LiWenchang，LiPing，YangZhiming，LiWei，WangLuyu作者单位：李文昌,李威,王鲁豫,LiWenchang,LiWei,WangLuyu(电子科技大学电子薄膜与集成器件国
7、家重点实验室,成都,610054)，李平,LiPing(电子科技大学电子薄膜与集成器件国家重点实验室,成都610054;成都华微电子科技有限公司,成都610041)，杨志明,YangZhiming(成都华微电子科技有限公司,成都,610041)刊名：半导体技术英文刊名：SemiconductorTechnology年，卷(期)：2011,36(11)参考文献(10条)1.VirtexⅡplatforrnFPGAuserguide20072.HANSRAsingle-pathpulsewidthcontrolloopwithabuiltinde
8、laylockedloop2005(05)3.向志华FPGA中延迟锁相环的设计20084.李兆静FPGA内全数字锁相环的设计[学位论文]20095.KWANSUHK
