基于fpga的数字时钟设计

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1、毕业设计（论文）题目：基于FPGA的数字时钟设计学生姓名：学号：所在学院：专业班级：届别：指导教师：皖西学院本科毕业设计（论文）创作诚信承诺书1.本人郑重承诺：所提交的毕业设计（论文），题目《基于FPGA的数字时钟设计》是本人在指导教师指导下独立完成的，没有弄虚作假，没有抄袭、剽窃别人的内容；2.毕业设计（论文）所使用的相关资料、数据、观点等均真实可靠，文中所有引用的他人观点、材料、数据、图表均已标注说明来源；3.毕业设计（论文）中无抄袭、剽窃或不正当引用他人学术观点、思想和学术成果，伪造、篡改数据的情况；4.本人已被告知并清楚：学校对毕业设计

2、（论文）中的抄袭、剽窃、弄虚作假等违反学术规范的行为将严肃处理，并可能导致毕业设计（论文）成绩不合格，无法正常毕业、取消学士学位资格或注销并追回已发放的毕业证书、学士学位证书等严重后果；5.若在省教育厅、学校组织的毕业设计（论文）检查、评比中，被发现有抄袭、剽窃、弄虚作假等违反学术规范的行为，本人愿意接受学校按有关规定给予的处理，并承担相应责任。学生（签名）：日期：年月日目录前言11绪论21.1课题研究背景21.2国内外研究现状22关键技术的探讨32.1FPGA技术简介32.2VERILOGHDL42.3VHDL42.4VERILOGHDL和V

3、HDL的比较52.5设计所涉及的软件53数字时钟的设计原理53.1数字时钟53.2数字时钟构成53.3各功能模块工作原理64数字时钟的系统设计方案74.1工作原理和系统框图74.2程序流程图75数字时钟的模块仿真105.110进制模块仿真105.224进制模块仿真105.360进制模块仿真105.4分频模块115.5触发器模块115.6译码显示模块126总结与展望12参考文献：13基于FPGA的数字时钟设计基于FPGA的数字时钟设计学生：刘晓晴（指导老师：傅思勇）（皖西学院信息工程学院）摘要:在生活中，经常会遇到需要用时间来测量参数，继而用来生

4、产生活。数字电路使用FPGA进行设计灵活通用，让FPGA设计电路成为现代数字电路设计的首选方式之一。本文的时钟设计是在QuartusⅡ软件环境下，利用VHDL描述逻辑，使用自顶向下模式的利用FPGA设计的一个数字时钟。本系统由按键控制数字时钟的清零和停启，可以分别显示时，分，秒。这次实验运用的是FPGA技术，采用的VHDL汇编语言，结合各个模块再在QuartusII仿真软件上进行仿真。其中的FPGA技术是这次实验的亮点，它容易掌握，各模块分工清晰，在仿真软件上易于操作，还可以适应许多种环境，总的系统性能指标是非常有保障的。关键词:数字时钟；FP

5、GA；VHDL；QuartusIIThedesignofDigitalClockbasedonFPGAStudent:LiuXiaoqing(FacultyAdviser：FuSiyong)(CollegeofInformationEngineering,WestAnhuiUniversity)Abstract:Inourlife,oftenneedtouseaclocktomeasureparameter,andthenusedforproductionandliving.Ithasbecomeapopularmethodtodesigndi

6、gitalcircuitbyusingFPGAbecauseofitsflexibilityandversatility.ThisdesignuseVHDLlanguagemeansforthesystemdesigndocumentsinQuartusIItoolsenvironment,atop-downdesign,bythevariousmodulestogetherbuildaFPGA-baseddigitalclock.Thesystemcancompletethehours,minutes,andsecondsrespective

7、ly,usingkeystocleared,startandstopthedigitalclock.TheFPGAtechnologyisthehighlightoftheexperiment,itiseasytograsp,cleardivisionoflabor,variousmodulesonthesimulationsoftwareiseasytooperation,alsocanadaptmanykindsofenvironment,theoverallsystemperformanceisguaranteed.Keywords:di

8、gitalclock;FPGA;VHDL;QuartusII前言14基于FPGA的数字时钟设计随着时代的进步与科技的发展，人们的生活水平也越来越好，而