数字电子技术基础(阎石第5版)6.pdf

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1、290第六章时序逻辑电路表6.3.6图6.3.19电路的状态转换表电一路状百等进一效制一十数一-om-000000001-02000011110态输出-600110011000-111000-111。。C。"。咽且由咀嚼且。"'且血。h:··!HOB--oil--01234567890-mu6-UH4-MO'且叫，"句OO3A。丛『。、56789ω-012-012-012;1。←血"。"。。，且I1血咀嚼且。"10-1。。血"一。"-amoo-"'Aav-00·aa"-a"'。'AAO1且一'且唱且'且一'且'且。"一'且'且。"一‘且。一一一

2、•。1OJ;。'AOM臼1且。"0号....__...'2图6.3.20图6.3.19电路的状态转换图6.3若干常用的时序逻辑电路291图6.3.21是中规模集成的同步十进制加法计数器74160的逻辑图。它在图6.3.19所示电路的基础上又增加了同步预置数、异步置零和保持的功能。图中LD'、R~、Do-D3、EP和ET等各输入端的功能和用法与图6.3.13电路中对应的输入端相同，不再赘述。74160的功能表也与74161的功能表(表6.3.4)相同。所不同的仅在于74160是十进制而74161是十六进制。LD'l>rIJQoþ>Cl./Dob

3、￥lKRJ•-IJ[‘Q,þ>ClD,,lKR'"一CLK1,.,)0lJQ2i>ClDlK2RP•-n,ruIJQ3y/二ClDlKRPJR{,t>>EPETC图6.3.21同步十进制加法计数器74160的逻辑图、图6.3.22是同步十进制减法计数器的逻辑图。它也是从同步二进制减法计数器电路的基础上演变而来的。为了实现从Q3Q2Q，QO=0000状态减1后跳变成1001状态，在电路处于全0状态时用与非门G2输出的低电平将与门G，和G3封锁，使T，=T2=0。于是当计数脉冲到达后FF。和FF3翻成1，而FF，和FF2维持。不变。以后继续输入减法

4、计数脉冲时，电路的工作情况就与图6.3.15所示的同步二进制减法计数器一样了。292第六章时序逻辑电路由图6.3.22可直接写出电路的驱动方程To=1T1=Q~(Q;Q~Q~)'(6.3.12)T2=Q~Q;(Q;Q~Q~)'T3=Q~叭叭将上式代人T触发器的特性方程得计数脉冲FFoCLK到电路的状态方程为1)QoQJ=Q;几~1>CllK扣-Ql+=Q~(Q;Q~Q;)'Q;FFlG+(Q~(Q;Q~Q;)')'Ql11)QlT1>ClQ2+=Q~Q;(Q;Q~Q~)'Q~lK0-G2+(Q~Q;(Q;Q~Q;)')'Q2r-pQ3+=Q~Q

5、;Q~Q~+(Q~Q;Q~)'Q3FF21JQ2经化简后得到凡>CIQo'=Q~G3lKQ;=Q~(Q2+Q3)Q;+QOQlFF31JQ3Q2+=(Q~Q;Q3)Q~+(Qo+Ql)Q2T3>ClGlK0-Q3'=(Q~Q;Q~)Q;+(Qo+Ql+Q2)Q34(6.3.13)飞B根据式(6.3.13)即可列出表6.3.7所Gs示的状态转换表，并可画出图6.3.23所示的状态转换图O图6.3.22同步十进制将图6.3.19所示同步十进制加法计数减法计数器电路器的控制电路和图6.3.22所示同步十进制减法计数器的控制电路合并，并由一个加/减控制

6、信号进行控制，就得到了图6.3.24所示的单时钟同步十进制加/减计数器电路74LS190。由图可知，当加/减控制信号U'/D=0时做加法计数;当U'/D=1时做减法计数。其他各输入端、输出端的功能及用法与同步十六进制加/减计数器74LS191完全类同。74LS190的功能表也与74LS191的功能表(见表6.3.5)相同。同步十进制加/减计数器也有单时钟和双时钟两种结构形式，并各有定型的集成电路产品出售。属于单时钟类型的除74LS190以外还有74LS168、CC4510等，属于双时钟类型的有74LS192、CC40192等。6.3若于常用的时

7、序逻辑电路293表6.3.7固6.3.22电路的状态转换表计数电路状方，钮，王借位等效十进制数顺序Q,Q2。1。。B。。。。。←。。11。。1-斗9。21。。。8。。1117。34。11。6。。1。15。5。1。。4。67。。113。8。。1。2。9。。。1。10。。。。.---。1。111115。1111。14。211。113。311。。12。41。1I11。51。1。10。1.......961。。。图6.3.23图6.3.22电路的状态转换图294第六章时序逻辑电路CLK..CLKoU'ID、飞飞CIB•Do、、Lr<

8、...rλJSQlp...LD-tJ二iQ2、pD」Q31>-二LD.---图6.3.24单时钟同步十进制加/减计数器74LS190二、异步计数