逻辑门电路功能测试.doc

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1、实验二集成逻辑门电路功能测试及其连接和驱动[实验目的]1、熟悉数字电路实验箱中各种装置，如逻辑开关、发光二极管信号灯、集成电路插座、专用迭插导线。2、测试与非门、或非门、非门、与或非门电路的逻辑功能。3、掌握集成逻辑门电路相互连接时应遵守的规则和实际连接方法。[实验原理]1、集成逻辑门电路本实验中所用集成门电路有与非门(集成块型号为74LS00，内含4个二输入端与非门)、或非门(集成块型号为74LS02，内含4个二输入端或非门)、非门(集成块型号为74LS04，内含6个非门)、与或非门(集成块型号为74LS54，内含1个十输入端的与或非门)。AABY+YAY+YCBD(a)与非

2、门(b)或非门(c)非门(d)与或非门图4-2-1逻辑功能符号图2、门电路的逻辑函数式：———与非门：Y=AB(二输入端)————或非门：Y=A+B(二输入端)——非门：Y=A———————与或非门：Y=AB+CD(四输入端)3、TTL门电路输入输出电路性质当输入端为高电平时，输入电流是反向二极管的漏电流，电流极小。其方向是从外部流入输入端。当输入端处于低电平时，电流由电源VCC经内部电路流出输入端，电流较大，当与上一级电路衔接时，将决定上级电路应具的负载能力。高电平输出电压在负载不大时为3.5V左右。低电平输出时，允许后级电路灌入电流，随着灌入电流的增加，输出低电平将升高，一

3、般LS系列TTL电路允许灌入8mA电流，即可吸收后级20个LS系列标准门的灌入电流。最大允许低电平输出电压为0.4V。4、CMOS电路输入输出电路性质一般CC系列的输入阻抗可高达1010Ω，输入电容在5pF以下，输入高电平通常要求在3.5V以上，输入低电平通常为1.5V以下。因CMOS电路的输出结构具有对称性，故对高低电平具有相同的输出能力，负载能力较小，仅可驱动少量的CMOS电路。当输出端负载很轻时，输出高电平将十分接近电源电压；输出低电平时将十分接近地电位。在高速CMOS电路54/74HC系列中的一个子系列54/74HCT，其输入电平与TTL电路完全相同，因此在相互替代时，

4、不需考虑电平的匹配问题。5、集成逻辑电路的连接在实际的数字电路系统中总是将一定数量的集成逻辑电路按需要前后连接起来。这时，前级电路的输出将与后级电路的输入相连并驱动后级电路工作。这就存在着电平的配合和负载能力这两个需要妥善解决的问题。通常可用下列几个表达式来说明连接时所要满足的条件：VOH(前级)≥ViH(后级)VOL(前级)≤ViL(后级)IOH(前级)≥n×IiH(后级)IOL(前级)≥n×IiL(后级)（注：n为后级门的数目）(1)TTL电路与TTL电路的连接TTL集成逻辑电路的所有系列，由于电路结构形成相同，电平配合比较方便，不需要外接元件可直接连接，不足之处是受低电平

5、时负载能力限制的。(2)TTL电路驱动CMOS电路TTL电路驱动CMOS电路时，由于CMOS电路的输入阻抗高，故此驱动电流一般不会受到限制，但在电平配合问题上，低电平是可以的，高电平时有困难，因为TTL电路在灌载时，输出高电平通常低于CMOS电路对输入高电平的要求，因此为保证TTL输出高电平时，后级的CMOS电路能可靠工作，通常要外接一个提位电阻R，如图4-2-2所示，使输出高电平达到3.5V以上，R的取值为2~2.6KΩ较合适，这时TTL后级的CMOS电路的数目实际上是没有什么限制的。图4-2-2TTL电路驱动CMOS电路(3)CMOS电路驱动TTL电路CMOS的输出电平能满

6、足TTL对输入电平的要求，而驱动电流将受限制，主要是低电平时的负载能力。除了74HC系列外，其它的CMOS电路驱动TTL的能力都较低。既要使用此系列又要提高其驱动能力时，可采用以下两种方法：①采用CMOS驱动器，如CC4049、CC4050是专为给出较大驱动设计的CMOS电路。②几个同功能的CMOS电路并联使用，即将其输入端并联，输出端并联(而TTL电路是不允许并联的)。(4)CMOS电路与CMOS电路的连接CMOS电路之间的连接十分方便，不需另外外接元件。对直流参数来讲，一个CMOS电路可带动的CMOS电路数量是不受限制的。但在实际使用时，应当考虑后级门输入电容对前级门的传输

7、速度的影响，电容太大时，传输速度要下降，因此在高速使用时要从负载电容来考虑，例如CC4000T系列。CMOS电路在10MHz以上速度运用时应限制在20个门以下。[实验设备与器件]1、+5V直流电源；2、逻辑电平开关；3、逻辑电平显示器；4、逻辑笔；5、直流数字电压表；6、直流毫安表；7、74LS00×274LS0274LS0474LS54CC400174HC00；8、电阻：100Ω470Ω3KΩ；9、电位器：47K10K4.7K。[实验内容与步骤]1、测试与非门逻辑功能选用型号为74LS00