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时间:2020-03-05
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1、3.4集成组合逻辑电路第一节组合电路的分析和设计第二节常用的组合逻辑电路第五节可编程逻辑器件PLD概述第三节随机存取存储器(RAM)第四节可编程只读存储器PROM一组合电路输入:逻辑关系:Fi=fi(X1、X2、…、Xn)i=(1、2、…、m)特点:电路由逻辑门构成;不含记忆元件;输出无反馈到输入的回路;输出与电路原来状态无关。输出:X1、X2、…、XnF1、F2、…、Fm第一节组合电路的分析和设计二组合电路的分析分析已知逻辑电路功能步骤:输出函数表达式简化函数真值表描述电路功能已知组合电路例:试分析右图所示逻辑电路的功能。因此该电路为少数服从多
2、数电路,称表决电路。解:(1)由电路图得逻辑表达式(2)由逻辑表达式得真值表ABCF00000010010001111000101111011111真值表(3)功能分析:多数输入变量为1,输出F为1;多数输入变量为0,输出F为0。三组合电路的设计步骤:根据要求设计出实际逻辑电路确定输入、输出列出真值表写出表达式并简化画逻辑电路图形式变换根据设计所用芯片要求选择所需门电路根据设计要求分析题意,将设计要求转化为逻辑关系,这一步为设计组合逻辑电路的关键例:半加器的设计解:(1)半加器真值表(2)输出函数输入输出被加数A加数B和S进位C000001101
3、0101101分析:半加器是将两个一位二进制数相加求得和及向高位进位的电路。因此,有两个输入(加数与被加数)及两个输出(和与进位)。设被加数和加数分别为A和B,和与进位分别为S、C,真值表为:(3)逻辑图(4)逻辑符号(2)输出函数由表达式知,若无特别要求,用一个异或门和一个与门即可实现半加器电路。电路图为:半加器逻辑符号全加器是实现例:全加器的设计。全加器真值表输入输出AiBiCiSiCi+10000000110010100110110010101011100111111一位二进制数一位二进制数低位来的进位相加和高位进位不讲第二节常用的组合逻辑
4、电路一、编码器二、译码器三、多位加法器四、数字比较器五、数据选择器和数据分配器一、编码器逻辑功能:任何一个输入端接低电平时,三个输出端有一组对应的二进制代码输出。1、二进制编码器将输入信号编成二进制代码的电路,如右图三位二进制编码器(8线—3线编码器)。任何时刻只允许一个输入端有信号输入。一般地说,用文字、符号或数码表示特定信息的过程称为编码,即用一组二进制代码表示它们。能够实现编码功能的逻辑部件称为编码器。2、8421BCD编码器8线—3线优先编码器CT74LS148编码输出编码输入使能输入使能输出扩展输出3、优先编码优先编码器允许几个输入端同
5、时加上信号,电路只对其中优先级别最高的信号进行编码。二、译码器(一)二进制译码器二进制译码器输入输出满足:m=2n译码输入译码输出a1a0y0y1y2y30010000101001000101100012位二进制译码器如:2—4译码器3—8译码器4—16译码器译码输入译码输出a1a0y0y1y2y30001110110111011011111102位二进制译码器译码输入:n位二进制代码译码输出m位:一位为1,其余为0或一位为0,其余为1译码器—将输入代码转换成特定的输出信号写出各输出函数表达式:BAEIY=1译码输入,二进制编码0-7依次对应8个
6、输出。3—8译码器(74LS138)八个输出端,低电平有效。译码状态下,相应输出端为0;禁止译码状态下,输出均为1。~S1、使能输入,与逻辑。EN=1(EN=0,禁止译码,输出均为1。),译码。A0~A2(二)数字显示译码器常用的数字显示器有多种类型,按显示方式分,有字型重叠式、点阵式、分段式等。按发光物质分,有半导体显示器,又称发光二极管(LED)显示器、荧光显示器、液晶显示器、气体放电管显示器等。1.七段数字显示器原理按内部连接方式不同,七段数字显示器分为共阴极和共阳极两种。2.七段显示译码器7448七段显示译码器7448是一种与共阴极数字显
7、示器配合使用的集成译码器。7448的逻辑功能:(1)正常译码显示。LT=1,BI/RBO=1时,对输入为十进制数l~15的二进制码(0001~1111)进行译码,产生对应的七段显示码。(2)灭零。当LT=1,而输入为0的二进制码0000时,只有当RBI=1时,才产生0的七段显示码,如果此时输入RBI=0,则译码器的a~g输出全0,使显示器全灭;所以RBI称为灭零输入端。(3)试灯。当LT=0时,无论输入怎样,a~g输出全1,数码管七段全亮。由此可以检测显示器七个发光段的好坏。LT称为试灯输入端。(4)特殊控制端BI/RBO。BI/RBO可以作输入
8、端,也可以作输出端。作输入使用时,如果BI=0时,不管其他输入端为何值,a~g均输出0,显示器全灭。因此BI称为灭灯输入端。作输出端使用
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