第十三章时序逻辑电路.ppt

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1、13.1寄存器13.2二进制计数器本章小结第十三章　时序逻辑电路13.3十进制计数器13.4时序逻辑电路的应用13.1.1数码寄存器1．电路结构13.1寄存器13.1寄存器输入端：D0~D3是寄存器的数码输入端。输出端：Q0~Q3是寄存器的数据输出端。清零端：各触发器的复位端连接在一起，作为寄存器的总清零端，低电平有效。控制端：4个触发器的时钟脉冲输入端连接在一起，作为接收数码的控制端。数码寄存器（寄存器）：只具有接收、暂存数码和清除原有数码的功能。（1）寄存数码前，寄存器应清零：令=0，Q0~Q3均为0态。（2）寄存数码时，应使=1。将待寄存的四位二进制数码D0~D3分别输入D触发

2、器各自的输入端。当时钟信号CP的上升沿到来时，根据D触发器的逻辑功能Qn+1=D，二进制数码得以输入寄存器。在接收数码时，各位数码是同时输入；输出数码时，也是同时输出。因此，这种寄存器称为并行输入、并行输出数码寄存器。3．特点2．工作过程（3）只要使=1，CP=0，寄存器就处在保持状态。完成了接收并暂存数码的功能。13.1寄存器13.1.2移位寄存器（1）右移寄存器1．单向移位寄存器FF3是最高位触发器，FF0是最低位触发器，从左到右依次排列。高位触发器的输出端Q与低一位触发器的输入端D相连。整个电路只有最高位触发器FF3的输入端D接收输入的数码。①电路组成13.1寄存器②工作原理假

3、设初始状态D0D1D2D3=0000，要输入数据为1101；第一个CP上升沿到来后：D0=1存入FF3，Q3=1，其他三个触发器保持0态不变。1000。第二个CP上升沿到来后：D1=0移到FF3中，而Q3=1移到FF2中，此时。Q1、Q0仍为0态。0100；接收数码前，寄存器应清零。令=0，则各位触发器均为0态。接收数码时，应使=1。13.1寄存器第四个CP上升沿到来后：D3=1移到FF3中，其余各位触发器依次右移，结果Q0Q1Q2Q3=1001。第三个CP上升沿到来后：D2=1移到FF3中，Q3=0移到FF2中，Q2=1移入FF1，而FF0状态仍为0态。1010；13.1寄存器③状

4、态表CP输入Q3Q2Q1Q0012340101100001000010010101101④特点右移寄存器具有串行输入、串并行输出的功能。又可从最低位的输出端处输出，只需要连续送入4个CP脉冲，存放4位数码将从低位到高位，依次从Q0串行输出端处输出，这就是串行输出方式。从4个触发器的输出端可同时输出4位数码，即并行输出。13.1寄存器⑤波形图13.1寄存器（2）左移寄存器串接顺序由低位到高位。寄存的数码从低位的D端输入，从最高位的输出端串行输出。①电路组成13.1寄存器②工作原理假设存入数据D3D2D1D0=1101。接收数码前，寄存器应清零。令=0，则各位触发器均为0态。接收数码时，

5、应使=1。第一CP上升沿到来后：Q3Q2Q1Q0=0001。第二CP上升沿到来后：Q3Q2Q1Q0=0001；第三CP上升沿到来后：Q3Q2Q1Q0=0110。第四CP上升沿到来后：Q3Q2Q1Q0=1101；13.1寄存器2．双向移位寄存器具有既能右移又能左移两种工作方式的寄存器，称为双向移位寄存器。（1）集成4位双向移位寄存器CT74LS194的外引线排列M0、M1为工作方式控制端，其取值不同，功能不同：保持、右移、左移及并行输入。13.1寄存器（2）CT74LS19逻辑功能表（3）工作过程分析④M1M0=11，寄存器处于并行输入工作方式，CP上升沿将并行输入的数据D0~D3传送

6、到寄存器的并行输出端。功能01111××00011011清零保持右移左移并行输入②M1M0=01，右移，CP上升沿，DSR右移输入端的串行输入数据依次右移。。①M1M0=00，寄存器中的数据保持不变。③M1M0=10，左移，CP上升沿，DSL左移输入端的串行输入数据依次左移。13.1寄存器13.2二进制计数器1．电路组成13.2.1异步二进制加法计数器（1）分析：结构特点－低位触发器Q端接至高位触发器的C端。（2）J=K=1，Qn+1=翻转功能。2．工作原理（1）当第一个CP脉冲下降沿到来时，FF0翻转，Q0由0变为1。而Q0的正跳变信号对触发器不起作用，FF1、FF2保持原态。计数

7、器状态为001。（2）当第二个CP脉冲下降沿到来时，FF0再次翻转，Q0由1变为0。Q0是负跳变信号，作用到FF1的C端，使FF1状态翻转，Q1由0变为1。而FF2仍保持原态不变。计数器状态为010。接收数码前，寄存器应清零。令=0，则Q2Q1Q0=0。13.2二进制计数器（3）按此规律，当第七个CP脉冲输入后，计数器的状态为111，再输入一个CP脉冲，计数器的状态又恢复000。13.2二进制计数器3．状态表输入CP脉冲序号0000100120103011