四选一多路选择器Verilog代码及仿真结果MUX_4.doc

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1、modulemux_df(a,b,c,d,s1,s0,y);inputa,b,c,d,s1,s0;outputy;assigny={!s1&&!s0}?a:{!s1&&s0}?b:{s1&&!s0}?c:d;endmodulemodulemux_tb();rega,b,c,d,s1,s0;wirey_df;mux_dfmux_df_tb(.a(a),.b(b),.c(c),.d(d),.s1(s1),.s0(s0),.y(y_df));initialbegina<=0;b<=0;c<=0;d<=0;s1<=0;s0<=0;endalways#1a<=~a;always#2b

2、<=~b;always#4c<=~c;always#8d<=~d;always#16s1<=~s1;always#32s0<=~s0;endmodule

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