数字逻辑复习题

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1、姓名：学号：班级：院（部）：系（教研室）主任签字：教学院长（主任）签字：一、选择题1.若变量A，B，C，D，E取值为10011时，某最小项的值为1，则此最小项是【C】。A.B.C.D.2.下面逻辑式中，正确的是【D】。A.B.C.D.3．实现一个十进制的可逆计数器，至少需要【B】个触发器。A.3B.4C.5D.64．逻辑式相等的式子是【C】A．ABCB．A+BCC．D．A5．八路数据选择器，其地址输入端（选择控制端）有【A】个。A．3B．2C．4D．86．对于JK触发器，输入J=0，K=1，CP脉冲作

2、用后，触发器次态应为【A】。A．0B.1C.保持D.翻转7．一个五位的二进制加法计数器，由0000状态开始，按自然二进制码的顺序计数，问经过75个输入脉冲后，此计数器的状态为【A】。A.01011B.11010C.11111D.100118．PLA是指【D】的逻辑器件。A.与、或阵列都固定B.与阵列固定，或阵列可编程C.与阵列可编程，或阵列固定D.与、或阵列都可编程9．FPGA采用逻辑单元阵列结构，由三个基本模块阵列组成。【A】是系统的核心。A.可组态逻辑块B.通用逻辑块C.可编程互连连线D.可编程互

3、连连线10．下列逻辑部件中，不属于组合逻辑部件的是【C】A．译码器B．编码器C．计数器D．全加器11.某时序逻辑电路的波形如图所示，由此判定该电路是【B】。A.二进制计数器B.十进制计数器C.移位寄存器D.以上均不是12.在【A】情况下，函数运算的结果是逻辑“1”。A．全部输入是“0”B.任一输入是“0”C.仅一输入是“0”D.全部输入是“1”13.下列电路中，不属于时序逻辑电路的是【D】。A．计数器B．触发器C．寄存器D．译码器14.Moore型时序电路的输出【B】。A.与当前输入有关B.与当前状态

4、有关C.与当前输入和状态都有关D.与当前输入和状态都无关15.测得某逻辑门输入A、B和输出F的波形如下，则F(A，B)的表达式是【C】。A.F=ABB.F=A+BC.D.16.n个触发器构成的环形计数器中，有效状态最多有【B】个。A.nB.2nC.2n-1D.2n-2n17.采用4位比较器（74LS85）对两个四位数比较时，先比较【D】位。A．最低B.次高C.次低D.最高18.全加器中向高位的进位为【B】。A.B.C.D.第1页共8页第2页共8页姓名：学号：班级：19.八路数据分配器，地址输入端有【C

5、】个。A.1B.2C.3D.820.一位全加器（FA）的输入、输出信号常表示为【A】。A．，，；，B．，，；，C．1，1，1；，D．0，0，0；，21.一个8421BCD码计数器至少需要【B】个触发器。A.3B.4C.5D.1022.能实现从多个输入端中选出一路作为输出的电路称为【C】。A.触发器B.计数器C.数据选择器D.译码器23.八路数据选择器如图所示，该电路所实现的逻辑函数是【D】。A．B．C．D．24.同步时序电路和异步时序电路比较，其差异在于后者【B】。A．没有触发器B．没有统一的时钟脉冲

6、控制C．没有稳定状态D．输出只与内部状态有关25.八进制数（375.236）8的十六制数是【A】。A.(FD.4F)16B.(FD.4E)16C.(FC.4F)16D.(FD.3F)1626.下列逻辑函数中，与（A+B）(A+C)等价的是【C】。A.F=ABB.F=A+BC.A+BCD.F=B+C27.4:10线译码器，输入信号端有【D】个。A.10B.2C.3D.428.函数F的卡诺图如图所示，其最简与或表达式是【D】。A.B.C.D.29．用四选一数据选择器实现函数Y=，应使【A】。A.D0=D2

7、=0，D1=D3=1B.D0=D2=1，D1=D3=0C.D0=D1=0，D2=D3=1D.D0=D1=1，D2=D3=030.下图所示的组合逻辑电路，其函数表达式为【A】。A．B.C．D.31．时序电路中不可缺少的部分为【B】。A.组合电路B.记忆电路C.同步时钟信号D.组合电路和记忆电路32．n个触发器构成的计数器中，有效状态最多有【D】个。A.nB.2nC.2n-1D.2n33.把一个五进制计数器与一个四进制计数器串联可得到【D】进制计数器。A.4B.5C.9D.20第3页共8页第4页共8页姓名

8、：学号：班级：34.下面不属于简单可编程逻辑器件的是【C】。A．EPROMB．PALC．ISPD．GAL35.双向数据总线常采用【C】构成。A.数据分配器B.数据选择器C.三态门D.译码器36.最小项的逻辑相邻项是【B】。A．ABCDB.C.D.37.逻辑函数F（ABC）=A⊙C的最小项标准式为【C】。A.F=∑（0，3）B.C.F=m0+m2+m5+m7D.F=∑（0，1，6，7）38.一个四输入端与非门，使其输出为0的输入变量取值组合有【D】种。A.