Avalon总线规范介绍(二)

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1、嵌入式技术概述——Avalon总线规范介绍（二）8/29/2021Avalon总线规范介绍（二）Avalon主端口传输Avalon流水线传输Avalon流控制传输8/29/20212Avalon主端口传输Avalon主端口信号主端口基本读传输主端口基本写传输主端口的等待周期、建立时间、保持时间属性8/29/20213Avalon主端口传输Avalon主端口信号主端口传输常用的信号：1）waitrequest信号2）address信号2）readdata、writedata信号3）read、write信号4）byteenable信号有无片选信号？

2、主端口输入信号主端口服从waitrequest信号主端口只提供与主端口数据宽度的字边界对齐的地址：如32位主端口只提供与4个字节边界对齐的地址：0x00，0x04，0x08对字中的特定字节访问，采用byteenable信号信号宽度必须是8、16、32、64、128、256、512、1024同时使用，宽度必须相同指示主端口何时开始新的读写传输信号可以持续保持指示大于8位的主端口访问的特定字节段8/29/2021432位主端口byteenable信号byteenable[3..0]写操作1111全32位写操作00112个低字节的写操作11002个高

3、字节的写操作0001字节0的写操作0010字节1的写操作0100字节2的写操作1000字节3的写操作Avalon主端口传输Byteenable的每一位对应writedata的一个字节段8/29/20215Avalon主端口传输Avalon主端口信号主端口基本读传输主端口基本写传输主端口的等待周期、建立时间、保持时间属性8/29/20216Avalon主端口传输主端口基本读传输主端口基本读传输由主外设发起，从Avalon交换架构传输一个数据单元到主端口。传输在一个时钟周期内完成。(A)第一个周期在clk的上升沿开始。(B)主端口发出有效的addr

4、ess、byteenable和read信号。(C)在第一个周期内从Avalon交换架构返回有效的readdata(D)主端口在下一个clk的上升沿捕获readdata，并且置所有输出无效。主端口的读传输结束。另一次传输可在下一个周期开始。waitrequest信号无效8/29/20217(A)第一个周期在clk的上升沿开始。(B)主端口发出有效的address、byteenable和read信号。(C)Avalon交换架构在下一个clk的上升沿置waitrequest有效。(D)主端口在clk的上升沿接受waitrequest。这个周期称为等待

5、周期。(E)只要waitrequest有效，主端口保持其所有输出不变。(F)Avalon交换架构返回有效的readdata。(G)Avalon交换架构置waitrequest无效。(H)主端口在下一个clk的上升沿捕获readdata，并且置其所有的输出无效。读传输结束。另一次传输可以在下一个周期开始。具有等待周期的主端口读传输Avalon交换架构利用waitrequest信号暂停主端口8/29/20218Avalon主端口传输Avalon主端口信号主端口基本读传输主端口基本写传输主端口的等待周期、建立时间、保持时间属性8/29/20219Av

6、alon主端口传输主端口基本写传输主端口基本写传输由Avalon主外设发起，传输需要一个时钟周期。注意：clk信号的方向8/29/202110(A)写传输在clk的上升沿开始。(B)主端口发出有效的address、byteenable、writedata和write信号。(C)在clk的上升沿waitrequest是无效的，所以写传输结束。另一次传输可以在下一个周期接着开始。主端口基本写传输waitrequest信号无效8/29/202111(A)第一个周期在clk的上升沿开始。(B)主端口发出有效的address、writedata和writ

7、e信号。(C)waitrequest在clk的上升沿被置为有效，所以该周期变成第一个等待周期。主端口保持所有的输出不变。(D)waitrequest在clk的上升沿再次被置为有效，所以该周期成为第二个等待周期。主端口保持所有的输出不变。(E)Avalon交换架构置waitrequest无效。(F)在clk的上升沿waitrequest是无效的，所以主端口置所有的输出无效，写传输结束。另一个读或写传输可以在下一个周期开始。具有等待周期的主端口写传输Avalon交换架构利用waitrequest信号暂停主端口8/29/202112Avalon主端口

8、传输Avalon主端口信号主端口基本读传输主端口基本写传输主端口的等待周期、建立时间、保持时间属性8/29/202113Avalon主端口传输主端口的