湖南工业大学EDA实验指导书

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1、EDA实验指导书电气与信息工程学院EDA实验室2008年9月实验一QUARTUSII使用（简单逻辑电路设计与仿真）一.实验目的1.学习并掌握QuartusII开发系统的基本操作。1.掌握简/逻辑电路的设计方法与功能仿真技巧。一.实验仪器设备1.PC机，1台2.QuartusII软件开发系统，1套二.实验预习要求1.预习教材中的相关内容；2.预习老师教学演示的相关内容；3.阅读并熟悉本次实验内容。三.实验内容用原理图设计一个1位二进制的全加器（rti两个1位二进制半加器构成）并进行电路功能仿真与验证。四.实验操作步骤（1）开机，进入QuartusII开发系统;（2）在C盘建立白己的工程目录

2、（注意要以英文命名）；（3）在主菜单屮选NEW,从输入文件类型选择菜单屮选图形编辑文件输入方式BlockDiagram/SchematicFile,见图IT。图1-1输入文件类型选择菜单4）在空白屏幕上双击，从元件库中确定并选择基本元件。注意：从"讪子目录中选择输入引脚input和输出引脚output和相应的门电路。见图1-2。图1-2符号元件库选择日录（5）在图形编辑窗口完成电路的连线及对引脚的命名。OUTPUTimperr：OUTPUTIKPOT'"TJCCIAHD2X)>CO>SO图1-31位半加器的电路（6）打开FILE主菜单，选择SAVEAS,将画好的线路图以自己设定的某个名称

3、保存在自己的日录下（文件的扩展名必是.bdf）o（7）并将该设计文件指定成项目文件（选择菜单“FILE”fproject—addcurrentfiletoproject）.（8）对所设计的电路进行编译。（选择菜单“processing”-*■startcompile）.编译成功会弹出成功相关信息。（9）软件仿贞。在主菜单中选NEW,从输入文件类型选择菜单中选仿真波形文件VectorWaveformFile,见下图。(10)添加设计电路中的输入输出端口至下图的仿真波形文件，并将输入端口设置成周期不等的方波，保存设置好的文件，后缀为.vwfO■testX右®tetfbd啓AnPUmet③Co

4、mpiabonReport-FlowSsmary远Waveiofal.vwfQMa^erTimeBai:18.05n$<£JPloHer*5：Interval-179rwShitEndkANameValueot18.05nsj图1-4仿真波形编辑界而11)设置好的输入波形如图如示。(12)保存后,(选择菜单“processingvfstartsimulation)•点击仿真按钮,就可以进行波形仿真，以验证电路的逻辑功能。'amings自己完成一位二进制全加器的设计与验证:1＞用上面完成的半加器电路形成自定义元件（选择菜单FILE-^CreateDefaultSymbol）2.一位二进制全

5、加器电路原理图的设计，见下图1.存盘编译；2.进行波形仿真，验证电路;一.实验报告（见附1参考格式）1.统一格式，A4纸双而打印。（实验报告格式见附1）2.各部分电路的电路原理图或VHDL源程序。3.仿真结果及分析。实验二数控分频器设计与仿真一.实验目的1.学习并掌握QuartusIICPLD开发系统的操作技巧。2.掌握数字逻辑电路的设讣方法与功能仿真技巧。3.学习VIIDL源程序的编写调试方法。二.实验仪器设备1.PC机，1台2.QuartusII软件开发系统，1套三.实验预习要求1.预习教材中的相关内容；2.编写好数控分频器VHDL源程序。四.实验内容用VHDL设计一个数控分频器电路

6、，并进行功能仿真与验证，要求预置数为（2〜16）,使输入吋钟信号根据预置数的不同，实现2〜16分频。五.实验操作步骤（1）开机，进入QuartusII开发系统；（2）在F盘建立自C的目录（注意要以英文解）；（3）在主菜单中选NEW,从输入文件类型选择最后一项VHDLFile文本编辑输入方式，（4）输入VHDL源程序并保存,后缀名为.VHD。（5）检查修改语法错误。（6）编译.（7）建立仿真波形，进行电路逻辑功能验证。六.实验报告1.统一格式，A4纸双面打印。1.VHDL源程序。2.仿真结果及分析。实验三数字秒表的设计一.实验目的1.巩固和加深对QUARUS11CPLD开发系统的理解和使川

7、；2.掌握VHDL编程设计方法；3.掌握硕件实验装置使川方法；久掌握综合性电路的设计、仿真、下载、调试方法。二.实验仪器设备1.PC机1台2.QUARUSIICPLD软件开发系统，1套3.CPLD/FPGA实验系统及下载装置，1套三.实验内容设计一个计时范围为0秒〜90秒的数字秒表，用数码管显示当前秒表的计时值，并设置一个计时清零开关、一个计时起、停控制开关。设计思路：1.秒表的计时基准信号：以周期为1秒的计时脉冲CLK1作为一个比