数电基础复习要点

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1、第一章逻辑代数（重点）要求：1.1、1.2化简（公式法、卡诺图）,1.3各表示方法之间的转换一、公式和定理证明：应用：化简常用公式A•B+A•E=a二A•(B+B)=A并项法A+A•B二A=A・(1・B)=A推广：A+A()=A吸收法A+A•B=A+B=(A+A)・(a+B)二A+B消去法A•B+A•C+B•C=A•B+A•C不予证明配项消项法A-B+A-B=A-B+A-B异或的非为同或摩根定律：A・B=A+BA+B=A-B二、交换律、结合律、三、常用公式四、卡诺图①先画孤立项，按2、4、8-2n画相邻项②画大圈，少画圈③每个圈都有新的项加入习题第二章门电路要求：2.2简单分析

2、，2.4掌握概念（拉电流、灌电流、开门电阻、关门电阻和噪声容限）1拉电流：数字电路中0,1是根据电位高低区分的。在电位高时，下一级电路会从本级电路拉出一部分电流，即高电平输出，对负载提供电流。2灌电流：在电位低时，上一级电路会向本级电路灌入一部分电流，即低电平输111,要吸收负载的电流。3开门电阻：人们常把2.5Q称为TTL反相器电路的开门电阻，用表示。（相当于输入高电平）4关门电阻：人们常把0.7Q称为TTL反相器电路的关门电阻，用Rw表示。5噪声容限：是指Uo为规定值时，允许Ui波动的最大范围。6CMOS集成电路的主要特点：功耗极低，扇出能力强。（人们常把能带同类门电路的个

3、数称为扇出系数，其大小反映了扇111能力。）习题：第三章组合逻辑电路要求：3」分析和设计方法，3.2全加器各引脚功能，半加器概念，322、3.3、3.4功能表和简单拓展，不看原理,3.5（难点）会例题即可0分析方法：圖辑图I-圖辑痕送式一化简-I真值表I-说明功能设计方法：逻辑抽象一匱歴一亶裹亘一化简一壓图辺半加：两个1位二进制数相加，叫做半加。半加规则：两个1位二进制数相加，例如A和B相加，有三种情况，一是0+0=0；二是0+1=1；三是1+1=10。可见,半加结果有两个输出，一是半加和，一是半加进位。全加器：两个同位的加数和來自低位的进位三者相加，就是所谓的全加，实现这种运

4、算的电路称为全加器。74LS183加法器Cm表示来自低位（第i-1位）的进位G表示送给高位的（笫i+1位）的进位S表示全加和P1594位集成数值比较器的真值表P166集成8线一3线优先编码器的真值表P177集成3线一8线译码器的真值表P1884选1数据选择器P192数据分配器习题：第四章触发器要求：4.1、4.2、4.3记住功能表，什么是同步触发（考试不给功能表）一、基本RS触发器（低电平有效，11保持）S-Qn+,注11Qn保持100置1011置000不用不允许*Qn+1=S+KQnRS=0（约束条件）Rest：复位，置零Set：置1二、同步RS触发器（高电平有效，00保持）

5、CPRSQnQn+1注0XXXQn保持10000保持1001110101置11011111001置0110111110不用不允许1111不用*Qn+,=S+"Rq"RS=0（CP=1期间有效）三、同步D触发器*Qn+,=D（CP=1期间有效）四、边沿D触发器（7474是CP上升沿触发的边沿触发器）输入输出注CPDRdSdQn+1toil0同步置0fill1同步置1IXiiQn保持（1无效）XXo10异步置0XX1o1异步置1XXoo不用不允许*二D（CP上升或下降沿时刻有效）五、边沿JK触发器（高电平有效，00保持）*Qn+1=JQn+KQn六、同步触发：受时钟脉冲电平控制（C

6、P）的多个触发器同步工作习题：第五章时序逻辑电路要求：5」时序电路四个方程，5.2会看功能表（各引脚功能，考试给功能表），置零、置数，同步、异步,（难点）设计进制（如10进制一8进制）时钟方程输出方程驱动方程状态方程*详情解释见[例5.1.1]74161的状态表输入输出（现态Qn+1）CRIDCTpCTtCPDoD,D2D3QoQiq2QsCO注OXXXXXXXX00000清零1oXXtdod)d2d3dodid2d3CO=CTtC^3Q2QiQo1111tXXXX计数CO=C^Q2Q5Qo110xXXXXX保持CO=CTtC^q3q?qS11X0xXXXX保持0CR（clea

7、r）：异步清零LD：同步置数（加“0”信号的同时还需一个上升沿CP,即同步）CO：进位CTP、CTt：使能端N进制计数器一、用同步清零端或置数端归零获得N进制计数器的方法1.主要步骤①写出状态SN-i的二进制代码②求归零逻辑③画连线图2.应用举例［例521］试用74163构成十二进制计数器［解］⑴写出S“i的二进制代码Sn-1=S12-

8、=S

9、j=1011⑵求归零逻辑Y=Wo（即为“1”的项相与）⑶画连线图（a）用同步清零端C7?归零（b）用同步置数端厶D归零DO〜D3可以随意处理（现都接0